[技术问题解答]

KEA64 时钟配置问题

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zzgg86|  楼主 | 2015-4-28 15:57 | 显示全部楼层
ICS SETTING 如下图

ics setting

ics setting

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FSL_TICS_ZJJ| | 2015-4-28 16:30 | 显示全部楼层
本帖最后由 FSL_TICS_ZJJ 于 2015-4-28 16:38 编辑

楼主你好!
你现在用的芯片全称是什么?

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zzgg86|  楼主 | 2015-4-28 16:32 | 显示全部楼层
第一张图 左边 有显示 SKEAZN64MLH2 in LQFP 64-pin package

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FSL_TICS_ZJJ| | 2015-4-28 16:56 | 显示全部楼层
zzgg86 发表于 2015-4-28 16:32
第一张图 左边 有显示 SKEAZN64MLH2 in LQFP 64-pin package

你好!
我刚新建了一个,我认为这个是PE的bug,KEA64你选择的这款芯片应该是40M主频的,但是PE给加了个后缀2,认为是20M主频,所以限制了并且报错。

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FSL_TICS_ZJJ| | 2015-4-28 17:00 | 显示全部楼层
这个bug,我们会上报,不过,现在我看这样,你如果想要是32M,你可以先把ICS output prescaler配成2, 然后生成代码。
生成代码之后,你再手动修改下ICS_C2的BDIV值,这样还是能把主频给配成32M的。
56.jpg

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FSL_TICS_ZJJ| | 2015-4-28 17:01 | 显示全部楼层
然后,把CPU代码锁上:
57.jpg

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zzgg86|  楼主 | 2015-4-28 17:07 | 显示全部楼层
OK,多谢版主的解答。

另外,如果我想8M 外部时钟,生成core clock 40M,可以实现吗,怎么实现?  

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FSL_TICS_ZJJ| | 2015-4-28 17:24 | 显示全部楼层
zzgg86 发表于 2015-4-28 17:07
OK,多谢版主的解答。

另外,如果我想8M 外部时钟,生成core clock 40M,可以实现吗,怎么实现?   ...

不可以,因为FLL的系数是1024是死的。
你可以自己倒推下,如果要40M,那么输入FLL的就是39.0625K, 你8M经过整数分频,是不能达到这个值的。
况且,你的分频系数,还是由RDIV决定的。

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FSL_TICS_ZJJ| | 2015-4-28 17:24 | 显示全部楼层
zzgg86 发表于 2015-4-28 17:07
OK,多谢版主的解答。

另外,如果我想8M 外部时钟,生成core clock 40M,可以实现吗,怎么实现?   ...

要达到40M, 晶振上10M就可以了。

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zzgg86|  楼主 | 2015-4-28 17:28 | 显示全部楼层
FSL_TICS_ZJJ 发表于 2015-4-28 17:24
要达到40M, 晶振上10M就可以了。

我看到手册上有个例子,8M 可以输出CORE CLOCK 40M;这个是怎么实现的?

8-40

8-40

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FSL_TICS_ZJJ| | 2015-4-28 17:35 | 显示全部楼层
zzgg86 发表于 2015-4-28 17:28
我看到手册上有个例子,8M 可以输出CORE CLOCK 40M;这个是怎么实现的?

注释是错误的,你如果自己推一下就知道了。
8M/256 *1024=32M

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FSL_TICS_ZJJ| | 2015-4-28 17:38 | 显示全部楼层
本帖最后由 FSL_TICS_ZJJ 于 2015-4-28 17:39 编辑

关键是KEA64的FLL倍率是1024,手册上面278页写了,不是1280.
如果像KEA128的,FLL是1280,那么就是40M了。

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zzgg86|  楼主 | 2015-4-28 17:41 | 显示全部楼层
FSL_TICS_ZJJ 发表于 2015-4-28 17:35
注释是错误的,你如果自己推一下就知道了。
8M/256 *1024=32M

就是因为跟我计算的不一样,所以很纳闷,才问你的,
谢谢!   按照你的说法,那我们的理解应该是对的

非常感谢你的支持

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lvyunhua| | 2015-4-28 20:27 | 显示全部楼层
路过,学习了。

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FSL_TICS_ZJJ| | 2015-4-29 09:20 | 显示全部楼层
zzgg86 发表于 2015-4-28 17:41
就是因为跟我计算的不一样,所以很纳闷,才问你的,
谢谢!   按照你的说法,那我们的理解应该是对的

非常感谢你关于Kinetis的技术问题。如果你没有其他问题,我们将此帖默认为已解决.

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