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分享 Cadence study 30
aa为所当为 2017-5-24 21:52
三十、铜箔( shape ) 铜箔参数 Shape à Global Dynamic Params à Global Dynamic Shape Parameters 1 ) Shape fill Smooth 自动避开 Disabled 不自动避开 一般选用上面两种,经常用第一种 Xatch style 铜箔形式,一般使用 Hori_Vert 2 ) Void contro ...
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分享 Cadence study 28
aa为所当为 2017-5-24 21:48
二十八、蛇形线 如何走蛇形线 点击 Delay Tune— 然后再在画好的走线上,进行拉线 Gap: 指蛇形线相邻的线的距离,一般选用 3xwidth Style 中有蛇形线的三种模式 用途:等长
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分享 Cadence study 27
aa为所当为 2017-5-24 21:46
二十七、弧形线 如何走弧形线 替换方式 走线方式 Route/unsupported prototypes/Auto-interactive Convert Corner 用途 — 高速信号
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分享 Cadence study 26
aa为所当为 2017-5-24 21:44
二十六讲、 Allegro 布线控制面板( Visibility,Option,Find ) Visibility (层面显示) 可以打开和关闭层 还可显示去 gerber 的层,这些层在 artwork control form 可以看到 Plane 是内电层 Option (选项) Find (选取) ...
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分享 Cadence study 25
aa为所当为 2017-5-24 21:42
二十五、过孔的增加 定义过孔,当然孔得先做好 选 setup-constraints-physical 点击表格后面的 vias 弹出 Edit Via List 后选择左边做好的 VIA 过孔,点 OK 在画线的过程中双击鼠标左键换层就自动加上定义的过孔了(要保证 Options 下面的 VIA 里有定义好的 VIA ) ...
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分享 Cadence study 24
aa为所当为 2017-5-24 21:40
二十四、如何更新 PCB 库 步骤:点击 place ,选择 update symbols ,再选择 package symbols ,在你需要更新的元件封装号前打勾,在 update symbol padstacks 前打勾,注意一般要在 Ignore Fixed property 前打勾,点击 refresh ,完成 PCB 板同步 ...
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分享 Cadence study 23
aa为所当为 2017-5-24 21:38
二十三、颜色设置 1 、 Display à Color/Visibility à color Dilog Display: Temporary highlight 临时高亮颜色 Grids 格点颜色 Rats top-top Rats top-bottom Rats bottom—bottom Plan DRC ...
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分享 Cadence study 22
aa为所当为 2017-5-22 22:32
二十二、设置 No_rat 属性 1 、 Edit à properties à Find net à 选择 GND 网络或者其它你不希望显示飞线的网络 —apply— 赋参数 一般我们可以把 GND 和 VCC 等电源设置成 No_rat 上述方法为习惯用法,还可以用如下方法: 关闭飞线: display-- ...
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分享 Cadence study 20
aa为所当为 2017-5-22 22:24
二十、元件对齐 方法一: 选中 Setup-Placement application mode—placement edit 选中需要对齐的所有对象 右键点击参考对象,或者在空白处按住 Shift 右键单击,弹出菜单中选择 Align component 注意:如果元件散落成 x,y 方向都在可能对齐的样式,软件会选择其中不会 ...
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分享 Cadence study 19
aa为所当为 2017-5-22 22:05
十九、 Fixed 固定属性 Edit—properties à select symbol à fixed 点击感叹号标志, find 中选择 Symbols ,再点击所要查看的目标,可以看其属性 Unfixed 加上勾就解除固定
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