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zhangmangui 发表于 2018-3-5 22:58 建议直接编译试试 这样最好不容易出错
feihufuture 发表于 2018-3-6 08:40 考虑组内线序交换,反正我验证过P和N交换是没问题的,还是好好看手册吧
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或者是用FPGA生成IP核,产生硬件的管脚?类似于DDR3