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不用的IO口可以悬空吗?

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xia00|  楼主 | 2018-10-17 16:41 | 显示全部楼层 |阅读模式
不用的IO口可以悬空吗?还是有更好的办法,都接地的话,万一电路需要修改就麻烦了
hfdy01| | 2018-10-17 16:42 | 显示全部楼层
PGA的设计一般都是需要设置高阻状态的。

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CallReceiver| | 2018-10-17 16:44 | 显示全部楼层
设置为输出,输出低电平
P1DIR = 0XFF;
P1OUT = 0X00;

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boy1990| | 2018-10-17 16:48 | 显示全部楼层
不是有内部上拉/下拉么?用软件方法试试

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sourceInsight| | 2018-10-17 16:49 | 显示全部楼层
默认是输入,要是输入就不能“悬”了,悬着那就悬了。
要不设置为输出,要不就加个上拉!

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bbapple| | 2018-10-17 16:51 | 显示全部楼层
一般都是做悬空处理的啊,特别是想征程低功耗设计的时候是很有必要的

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handleMessage| | 2018-10-17 16:53 | 显示全部楼层
不可以悬空吧。
可以设置成三态。

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handleMessage| | 2018-10-17 16:53 | 显示全部楼层
最好不要悬空,这样的引脚信号不一定。

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zhouhuanの| | 2018-10-17 16:55 | 显示全部楼层
这个悬空引脚电压不一定怎么变化。

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wanglaojii| | 2018-10-17 16:57 | 显示全部楼层
可以弄个上拉电阻弄成高电平。

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laozhongyi| | 2018-10-17 16:59 | 显示全部楼层
用不到也可以悬空,有问题。

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Edisons| | 2018-10-17 17:00 | 显示全部楼层
最好能够设置到0或者1,不会影响单片机。

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_gege| | 2018-10-17 17:01 | 显示全部楼层
初始化会把所有IO口设置为输入状态

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Mozarts| | 2018-10-17 17:02 | 显示全部楼层
如果输入口悬空,可能会导致输入电平处于非0和非1的中间状态

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Listate| | 2018-10-17 17:03 | 显示全部楼层
一般的做法是通过一个电阻上拉到高电平或者下拉到低电平。

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dongliushui| | 2018-10-17 21:24 | 显示全部楼层
如果接地,就用0电阻接地,如果悬空就拉出来带个过孔。那边是空接。这样你想试用的时候可以通过引出的这个孔焊接飞线或者焊接元件。

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xiaoqi000| | 2018-10-17 21:44 | 显示全部楼层
可以悬空吧

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aspoke| | 2018-10-17 22:49 | 显示全部楼层
输入口不要悬空,尤其是输入阻抗高的,更不能悬空。

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232321122| | 2018-10-17 22:49 | 显示全部楼层
如果是IO口内带上拉电阻的,则可使用内部上拉电阻使其电位固定。

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ghuca| | 2018-10-17 22:50 | 显示全部楼层
一般都是空着的

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