FPGA设计经典书籍-资料汇总下载

只看该作者 · 2013-1-29 12:51

本帖最后由 hiramlee 于 2013-1-29 14:16 编辑

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FPGA Prototyping By Verilog Examples.part1.rar (4 MB)

FPGA Prototyping By Verilog Examples.part4.rar (4 MB)

FPGA Prototyping By Verilog Examples.part3.rar (4 MB)

FPGA Prototyping By Verilog Examples.part2.rar (4 MB)

FPGA Prototyping By Verilog Examples.part5.rar (307.05 KB)

digital Design and computer architecture.part07.rar (4 MB)

digital Design and computer architecture.part06.rar (4 MB)

digital Design and computer architecture.part05.rar (4 MB)

digital Design and computer architecture.part04.rar (4 MB)

digital Design and computer architecture.part03.rar (4 MB)

digital Design and computer architecture.part01.rar (4 MB)

digital Design and computer architecture.part08.rar (3.11 MB)

Advanced ASIC Chip Synthesis Using Synopsys Design Compiler,physical compiler an.rar (3.91 MB)

(Kluwer) Principles of Verifiable RTL Design (2nd Ed.).rar (3.7 MB)

A Guide to Digital Design and Synthesis, Second Edition.rar (2.14 MB)

数字信号处理的FPGA实现.part1.rar (4 MB)

数字信号处理的FPGA实现.part2.rar (2.74 MB)

无线通信FPGA设计.part2.rar (4 MB)

无线通信FPGA设计.part1.rar (4 MB)

无线通信FPGA设计.part3.rar (2.51 MB)

dspbuilder.rar (2.92 MB)

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本帖最后由 hiramlee 于 2013-1-29 14:46 编辑

FPGA设计指南：器件、工具和流程.part1.rar (4 MB)

继续

只看该作者 · 2013-1-29 12:53

本帖最后由 hiramlee 于 2013-1-29 14:17 编辑

继续

只看该作者 · 2013-1-29 12:55

继续

只看该作者 · 2013-1-29 13:39

额，好多啊。。。有没有网盘或者打包的连接啊

只看该作者 · 2013-1-29 14:09

刚刚上传的，抱歉没有用过网盘

只看该作者 · 2013-1-29 14:14

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只看该作者 · 2013-1-29 14:30

Xilinx FPGA开发实用教程_[田耘著][清华大学出版社][2008][625页].part31.rar (4 MB)

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IEEE_Std_1364-2001-what_new.rar (61.09 KB)

HuaWei Verilog 约束.rar (99.08 KB)

FPGA设计实战.part3.rar (2.89 MB)

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FPGA设计及应用.part3.rar (39.58 KB)

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FPGA开发全攻略(下册).part2.rar (221.04 KB)

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FPGA从零开始.rar (1.68 MB)

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只看该作者 · 2013-1-29 14:37

FPGA设计指南：器件、工具和流程.part1.rar少了。。。另外，感谢阿

只看该作者 · 2013-1-29 14:43

本帖最后由 hiramlee 于 2013-1-30 15:35 编辑

ａｒ

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只看该作者 · 2013-1-29 14:47

本帖最后由 hiramlee 于 2013-1-30 15:57 编辑

710303980 发表于 2013-1-29 14:37
FPGA设计指南：器件、工具和流程.part1.rar少了。。。另外，感谢阿

已经重新上传谢谢

The OpenRISC 1200 is an implementation of OpenRISC 1000 processor family.

The OR1200 is a 32-bit scalar RISC with Harvard microarchitecture, 5 stage integer pipeline, virtual memory support (MMU) and basic DSP capabilities.

Default caches are 1-way direct-mapped 8KB data cache and 1-way direct-mapped 8KB instruction cache, each with 16-byte line size. Both caches are physically tagged. By default MMUs are implemented and they are constructed of 64-entry hash based 1-way direct-mapped data TLB and 64-entry hash based 1-way direct-mapped instruction TLB. Supplemental facilities include debug unit for real-time debugging, high resolution tick timer, programmable interrupt controller and power management support.

General Microarchitecture