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 楼主| 发表于 2013-1-29 12:51 | 显示全部楼层 |返回版面||阅读模式
本帖最后由 hiramlee 于 2013-1-29 14:16 编辑

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icekoor + 3 强大
Death格雷尔 + 1 很给力!
bitshiyan + 3 赞一个!
503454911 + 3 赞一个!
luyaker + 1 这么……么……多……多

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With men this is possible;With God all things are possible!

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 楼主| 发表于 2013-1-29 12:52 | 显示全部楼层 |返回版面
本帖最后由 hiramlee 于 2013-1-29 14:46 编辑

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 楼主| 发表于 2013-1-29 12:53 | 显示全部楼层 |返回版面
本帖最后由 hiramlee 于 2013-1-29 14:17 编辑

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 楼主| 发表于 2013-1-29 12:55 | 显示全部楼层 |返回版面
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实习生

发表于 2013-1-29 13:39 | 显示全部楼层 |返回版面
额,好多啊。。。有没有网盘或者打包的连接啊

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 楼主| 发表于 2013-1-29 14:09 | 显示全部楼层 |返回版面
刚刚上传的,抱歉没有用过网盘
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中级技术员

发表于 2013-1-29 14:14 | 显示全部楼层 |返回版面

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实习生

发表于 2013-1-29 14:23 | 显示全部楼层 |返回版面

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 楼主| 发表于 2013-1-29 14:30 | 显示全部楼层 |返回版面

































































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 楼主| 发表于 2013-1-29 14:33 | 显示全部楼层 |返回版面
























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实习生

发表于 2013-1-29 14:37 | 显示全部楼层 |返回版面

FPGA设计指南:器件、工具和流程.part1.rar少了。。。另外,感谢阿

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 楼主| 发表于 2013-1-29 14:43 | 显示全部楼层 |返回版面

arm7官方源码

本帖最后由 hiramlee 于 2013-1-30 15:35 编辑

ar

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 楼主| 发表于 2013-1-29 14:47 | 显示全部楼层 |返回版面

OR1200 开发相关资料

本帖最后由 hiramlee 于 2013-1-30 15:57 编辑
710303980 发表于 2013-1-29 14:37
FPGA设计指南:器件、工具和流程.part1.rar少了。。。另外,感谢阿

已经重新上传 谢谢
The OpenRISC 1200 is an implementation of OpenRISC 1000 processor family.
The OR1200 is a 32-bit scalar RISC with Harvard microarchitecture, 5 stage integer pipeline, virtual memory support (MMU) and basic DSP capabilities.
Default caches are 1-way direct-mapped 8KB data cache and 1-way direct-mapped 8KB instruction cache, each with 16-byte line size. Both caches are physically tagged. By default MMUs are implemented and they are constructed of 64-entry hash based 1-way direct-mapped data TLB and 64-entry hash based 1-way direct-mapped instruction TLB. Supplemental facilities include debug unit for real-time debugging, high resolution tick timer, programmable interrupt controller and power management support.
General Microarchitecture
  • Central CPU/DSP block
  • IEEE 754 compliant single precision FPU
  • Direct mapped data cache
  • Direct mapped instruction cache
  • Data MMU based on hash-based DTLB
  • Instruction MMU based on hash-based ITLB
  • Power management unit and power management interface
  • Tick timer
  • Debug unit and development interface
  • Interrupt controller and interrupt interface
  • Instruction and Data WISHBONE B3 compliant interfaces
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版主

发表于 2013-1-29 14:54 | 显示全部楼层 |返回版面
看了楼主的图片也不敢不回贴啊
敬请关注:ATMEL论坛
竹密不防流水过,山高无障白云飞。

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高级工程师

发表于 2013-1-29 14:57 | 显示全部楼层 |返回版面
。。。。。。。太分散了
鄙视电工就是鄙视全人类的智慧;抛弃电子就是毁灭文明,人类将回到刀割火种的时代

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实习生

发表于 2013-1-29 15:23 | 显示全部楼层 |返回版面
有打包就好了,这样下着太累了。。。

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实习生

发表于 2013-1-29 15:34 | 显示全部楼层 |返回版面
谢谢分享,lz
[url=http://www.csnanren.com]湖南性保健研究所附属医院[/url]

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实习生

发表于 2013-1-29 15:54 | 显示全部楼层 |返回版面
真多啊

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初级工程师

发表于 2013-1-29 16:17 | 显示全部楼层 |返回版面
很强大
把你的悲伤留给自己  我的快乐让我带走

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初级技术员

发表于 2013-1-29 16:32 | 显示全部楼层 |返回版面
这样的帖子真得顶

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菜鸟003 + 1 很给力!
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