Xilinx RapidIO ip核端口不能初始化

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ldcxsp| | 2013-5-7 10:04 | 显示全部楼层
请问一下,您是怎么把RapidIO Ip核放入新工程的?
是把example_design放到新工程,然后添加srio 5.6吗?

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hzywlx|  楼主 | 2013-5-7 11:02 | 显示全部楼层
ldcxsp 发表于 2013-5-7 10:04
请问一下,您是怎么把RapidIO Ip核放入新工程的?
是把example_design放到新工程,然后添加srio 5.6吗? ...

是的。

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ldcxsp| | 2013-5-7 11:14 | 显示全部楼层
1 新建工程
2 通过newsource添加srio v5.6
3 把example_design所有文件考到工程通过addsource添加,每个文件都要添加吗?

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hzywlx|  楼主 | 2013-5-7 12:01 | 显示全部楼层
ldcxsp 发表于 2013-5-7 11:14
1 新建工程
2 通过newsource添加srio v5.6
3 把example_design所有文件考到工程通过addsource添加,每个文 ...

是啊,只要保证example_design_top下的所有模块都能识别就可以了。

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ldcxsp| | 2013-5-7 13:16 | 显示全部楼层
hzywlx 发表于 2013-5-7 12:01
是啊,只要保证example_design_top下的所有模块都能识别就可以了。

srio_v5_6_top.v 是指这个吗

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ldcxsp| | 2013-5-7 13:23 | 显示全部楼层
ldcxsp 发表于 2013-5-7 13:16
srio_v5_6_top.v 是指这个吗

我试了好几次都不行,能否发一个你的?

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qin552011373| | 2013-5-7 21:13 | 显示全部楼层
学习一下

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GoldSunMonkey| | 2013-5-7 23:04 | 显示全部楼层
qin552011373 发表于 2013-5-7 21:13
学习一下

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020931| | 2013-5-11 16:09 | 显示全部楼层
rapidio是如何初始化的,是一上电后就检测K28.5吗?

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GoldSunMonkey| | 2013-5-11 22:59 | 显示全部楼层
020931 发表于 2013-5-11 16:09
rapidio是如何初始化的,是一上电后就检测K28.5吗?

会自己初始化,然后握手

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XiaoWei369| | 2013-5-13 20:57 | 显示全部楼层
求猴哥帮助啊

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GoldSunMonkey| | 2013-10-8 23:07 | 显示全部楼层
这是怎么回事啊

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ningfen| | 2015-9-15 20:21 | 显示全部楼层
我在用v5的板子,用的是SRIO V5.6协议,我看到UG503上说可以环回测试验证,然后我就在外部用SMA将TX和RX对接,但是这样,port_initialed拉低状态,难道不可以只使用一个核进行环回测试吗?必须要再加一个核吗?另外example_design的VIO必须给信号,才能实现读写吗,不是直接固化在程序里面吗?
另外,可以再一片FPGA上使用两个SRIO核吗,我的方案是想加一个CPS1848芯片,作为stwich交换,通信。但是在一个工程里例化两个SRIO时,时钟错误一直有,就是约束文件

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happyhappy1| | 2019-5-15 13:22 | 显示全部楼层
GoldSunMonkey 发表于 2013-5-11 22:59
会自己初始化,然后握手

你好,刚刚接触rapidio,请问大佬可以帮助一下吗,现开始研究启动和初始化,不知道从下手,麻烦大佬提点一下

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dqwuf2008| | 2019-5-16 17:27 | 显示全部楼层
happyhappy1 发表于 2019-5-15 13:22
你好,刚刚接触rapidio,请问大佬可以帮助一下吗,现开始研究启动和初始化,不知道从下手,麻烦大佬提点 ...

同开始研究

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qldca| | 2019-10-10 11:22 | 显示全部楼层
旧核放入新工程先clean,再重新生成ip

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