chuxh 发表于 2017-8-12 10:28

每当内部fifo满时或者TCXpire跳转的时候丢一个数据


ep2in1024*4
   每512byts自动打包
TCXpire设置为1024byets

问题是每当内部fifo满时或者TCXpire跳转的时候丢一个数据，不知道问题在哪？

望有经验的人指点一下，谢谢~

juventus9554 发表于 2017-8-12 10:30


读数据的时候把目标地址指向实际地址的前一个字节（字）地址，即，实际数据放在0x8000，就把起始地址设为0x7FFF

stly 发表于 2017-8-12 10:32

或者就把数据放在0x8001，从0x8000读好了。

llljh 发表于 2017-8-12 10:35


不太明白，我是FPGA+68013-56pin，没有addr可以操作，能否说具体点怎么操作？

dingy 发表于 2017-8-12 10:37

好像是GPIF多给了一个时能给FPGAFIFO，但是68013又没有读到这个多给的使能的数据，很是奇怪

pengf 发表于 2017-8-12 10:39

用计数器补上这个数据

chuxh 发表于 2017-8-12 10:42

好像没什么规律可循

dingy 发表于 2017-8-12 10:44

看不懂你啥问题。。。。

chuxh 发表于 2017-8-12 10:46


类似于GPIF在给使能的时候多给了一个脉冲，导致丢了一数据，不知道问题出在哪？？

pengf 发表于 2017-8-12 10:50


既然是发生在一个波形的末尾或者是下一个波形的开头，就要仔细确认一下FIFO读波形的前端和末尾怎么设置的。

supernan 发表于 2017-8-12 10:51

感觉是波形错了。或者就是固件错。。

xxrs 发表于 2017-8-12 10:54



http://www.cypress.com/?rID=46029

你看看这个吧，有完整的例子

houcs 发表于 2017-8-12 10:56


不得不对cypress赞一个，他的文档就是贴心。

liuzaiy 发表于 2017-8-12 10:58

我是GPIF接DSP，可能有差别。官网也有SLAVE FIFO接FPGA的例子。

pangb 发表于 2017-8-12 11:04


恩那， 我也是用DSP和68013连接 用的是DSP的HPI接口和68013GPIF

juventus9554 发表于 2017-8-12 11:06

FPGA控制的话，大概率是接口timing的问题。

chuxh 发表于 2017-8-12 11:09

嗯，那我按大家的说法挨个排查一下，先结贴啦，谢谢哈

classroom 发表于 2024-5-29 11:04

检查并优化写入逻辑

laocuo1142 发表于 2024-5-29 16:00

在FIFO满或TCXpire触发时，添加额外的调试信息（如打印到控制台或写入日志文件），以便更好地了解此时系统的状态。

flycamelaaa 发表于 2024-5-29 17:00

检查硬件文档
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