hetao877
发表于 2020-3-12 20:24
黑金 Verilog HDL那些事儿——建模篇、时序篇、整合篇 资料包
本帖最后由 hetao877 于 2020-3-12 20:26 编辑
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部分文件截图：
haidai24
发表于 2022-8-12 18:25
学习
EBT
发表于 2022-8-27 16:11
{:smile:}
snowylin
发表于 2022-8-30 19:11
看看 谢谢！
Larry251314
发表于 2022-9-14 09:15
谢谢
暗夜47
发表于 2022-9-21 01:12
学习
enfupan
发表于 2022-9-21 19:46
拜谢
tx8282
发表于 2022-9-22 13:13
学习学习
sun2005
发表于 2022-9-22 14:30
好东西
tcklc
发表于 2022-9-22 20:51
{:biggrin:},谢谢！
yzxily
发表于 2022-9-24 22:58
大神，感谢分享
619888476
发表于 2022-9-28 10:13
感谢分享
你的小老姨
发表于 2022-9-30 09:21
{:lol:}
lxz282
发表于 2022-9-30 21:26
非常感谢
awdsn
发表于 2022-10-4 17:40
谢谢
登楼的猪
发表于 2022-10-17 17:41
好资料，谢谢分享。
askyforarm
发表于 2022-10-17 19:01
消息消息
bowened
发表于 2022-10-19 09:42
资料不错，谢谢分享
liuoulyy
发表于 2022-11-23 16:29
感谢，不错。
dwdwdwwd
发表于 2022-12-7 13:40
学习了