今日: 1|主题: 14266|帖子: 104574 收藏 (180)
多频连续波雷达数据实时压缩算法设计
2013-5-3 22:15 4 2533
赛灵思Kintex-7 FPGA KC705评估开发板详解
2013-5-2 21:25 0 6243
基于赛灵思基于FPGA的数字秒表设计与仿真
2013-5-2 21:23 0 2277
在LPM中找不到altsyncram,怎么解决 attach_img
2013-5-2 21:17 8 2128
结贴出现错误是怎么回事 attach_img
2013-5-1 16:08 1 1439
关于testbench基础求助
2013-5-1 16:07 8 1705
verilog模块里输入信号的问题
2013-5-1 16:06 6 2277
按键的verilog问题
2013-5-1 16:05 1 2441
采用FPGA设计SDH光传输系统设备时钟
2013-5-1 15:58 10 1929
下变频FFT的FPGA实现 attach_img agree
2013-4-28 22:02 13 3372
三段式状态机状态跳转如何理解 attach_img
2013-4-28 21:49 14 3038
这用的always,好吗? attach_img
2013-4-28 14:24 7 1927
XILINX 文件后缀名字的意义 agree  ...2
2013-4-28 10:30 21 4677
各位大神,请教一个关于CHIPSCOPE的问题
2013-4-28 10:27 6 2931
时钟问题
2013-4-27 16:22 8 2133
同步时钟
2013-4-27 11:10 14 3027
求助用VHDL/verilog实现16QAM调制
2013-4-27 10:02 1 2383
3M Camera Link 连接器
2013-4-27 09:23 4 2984
猴哥,求FPGA开发板资料
2013-4-27 00:36 6 2473
Virtex-6的时钟
2013-4-26 11:58 0 2770
Synopsys全新基于FPGA的原型验证解决方案
2013-4-26 11:53 4 2475
基于FPGA原型设计 能为您做些什么?
2013-4-26 10:43 6 2031
新思科技推出HAPS-600系列FPGA原型验证系统产品
2013-4-26 10:42 7 2581
[求助]为什么仿真时没有波形图
2013-4-26 07:58 2 1485
奇怪,声明的端口在rtl视图里看不见了 attach_img
2013-4-25 19:42 9 3011
modelsim综合后仿真时奇怪的高阻 attach_img
2013-4-25 11:49 11 4502
谁把特权同学的sdram控制器程序挑出来了?
2013-4-24 21:54 1 1746
高手朋友解释一下28 Gbps 收发器和100G的测试测量设备!
2013-4-24 21:34 3 1796
关于DM9000A初始化的问题
2013-4-24 18:53 2 3134
LVDS串并转换
2013-4-24 16:02 13 5254
奇怪的E3、L4脚
2013-4-24 12:25 4 1591
讨论个问题: 高速率 可扩展 背板总线。 attach_img
2013-4-24 08:24 15 2595
此信号能反应过来吗 attachment
2013-4-23 23:24 7 1941
HASS试验对CDR的PPM容忍度要求
2013-4-23 23:05 1 2133
谁看过特权同学的教程上的sdram控制器?
2013-4-23 17:37 4 2473
ALTERA的avalon总线IP移植到xilinx的难度有多大?
2013-4-23 13:05 2 2708
按键怎么产生一个脉冲
2013-4-23 10:09 1 2251
关于FPGA这块的实习问题
2013-4-22 20:04 6 2086
SignalTap下载完能自动采集分析吗
2013-4-22 15:44 0 1575
关于用Verilog函数读写文件的问题
2013-4-22 15:06 5 3538
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