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状态机异常进程信号 lczhoujq 2012-2-1 14:50 7 2584
[Quartus] DDR controller Controller DDR why2009a 2012-2-1 11:54 7 3136
需要Uart的IP核，求帮助 ip核 UART ip 星星之火红 2012-2-1 11:51 8 2407
EPCS选型时，EP4SGX530 = 189,000,000 bits这个数据是哪来的？选型 IO tancm 2012-2-1 09:35 4 4750
active在VHDL中是关键字吗？ active VHDL hlhfootbal 2012-1-31 22:06 0 2092
怎么产生coe文件. ROM nongfuxu 2012-1-31 16:50 14 14227
请教：Xst:2591 这样的警告要紧吗？ ST TE TI nongfuxu 2012-1-30 14:07 4 2060
请教:怎么对输出时钟进行约束? 时钟信号数模转换器 nongfuxu 2012-1-28 10:24 7 3256
[Quartus] 加入chipscope 后map 报错，请兄弟们帮看看 ChipScope mb number yuxhuitx 2012-1-27 10:26 3 10010
又遇到一个问题: ERROR:Place 1012 AC ce AI nongfuxu 2012-1-27 10:12 9 4357
头大的SCH! ST AD DDS nongfuxu 2012-1-26 18:01 2 2729
猴哥这个讲座卖羊头卖狗肉 ARM FPGA PGA edacsoft 2012-1-26 11:53 6 2379
altera可不可以动态配置io口? altera IO 指令 leasor 2012-1-22 09:40 3 2718
ISE V13中,怎么防止约束串扰? se 串扰管脚 nongfuxu 2012-1-21 16:54 7 3363
采用FPGA实现视频应用中的OSD设计 ...2 sd FPGA实现 os tikelu 2012-1-19 07:07 24 3956
[CPLD] 实际功耗大于datasheet上标注值 datasheet 电流 ic pianran 2012-1-18 23:54 5 2763
USB接口的使用 USB接口控制 FPGA michelle123 2012-1-18 23:06 9 2092
基于Virtex5的Gbps无线通信基站设计 Gbps virtex ertu 2012-1-18 21:23 16 2977
Xilinx 7Series FPGAS Series XILINX FPGAs jameswangchip 2012-1-18 15:46 1 2793
EDK中UCF EDK UCF michelle123 2012-1-18 12:42 9 2108
求一块Altera DE0，有的跟帖留言 altera LTE TE philoman 2012-1-18 01:14 1 2024
热烈欢迎“ddllxxrr”加入X-man勋章预备队 AN 赛灵思 FPGA SuperX-man 2012-1-17 20:39 11 2402
请教一段小代码，困扰了很久代码 ST RS tom_2_2 2012-1-17 16:49 3 1942
【休假通知】从明天起，我将休假。祝大家新春快乐。新春快乐说声对不起 GoldSunMonkey 2012-1-16 19:12 9 2402
epm7256停产了么？我急需几片啊。谁能帮我找找，真要命 tc thzbigone 2012-1-16 17:33 2 2512
请教ISE约束中时序的余量的设置时序 se hz nongfuxu 2012-1-16 14:12 5 2776
赛灵思推出关键互联IP打造新一代 LTE LTE 赛灵思 ip GoldSunMonkey 2012-1-16 13:12 11 2229
请教: 怎样理解ISE map后产生的REPORT? Report se ST nongfuxu 2012-1-16 13:10 3 3477
请教一个ISE使用进行时序约束的问题时序 se 时钟 nongfuxu 2012-1-16 09:53 5 3222
可编程系统芯片（PSC）在智能电池管理中的应用电池管理 opple 2012-1-16 07:17 7 2454
深入了解赛灵思System Generator中的时间参数 System 赛灵思 generator hihu 2012-1-16 07:15 9 2565
请教:spartan 3e的DCM_SP的时序约束 DCM spartan 时序 nongfuxu 2012-1-14 21:03 0 2837
ise 13.2 会自动添加IBUFG和BUFG嘛？ se 信号 ST nongfuxu 2012-1-14 15:45 13 6856
基于赛灵思FPGA的硬件加速技术打造高速系统赛灵思 FPGA opple 2012-1-13 15:59 5 2182
请教高手，关于Verilog HDL 程序编译编译 verilog HDL shizz 2012-1-13 14:54 2 2814
首本基于FPGA的SoC设计原型方法手册面世 FPGA SoC设计 ps ooljo 2012-1-13 07:14 0 1862
编译问题求助编译 hd ST hlhfootbal 2012-1-12 18:36 1 1903
热烈庆祝“明空”晋升为三级X-man ...2 AN 赛灵思 FPGA SuperX-man 2012-1-12 18:23 32 4980
FPGA调试基础知识 FPGA 基础知识调试 ooljo 2012-1-12 18:17 14 2330
pecl信号与cml信号应该怎么接? 信号 longcomeon 2012-1-12 17:24 2 2554