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[FPGA] 例说FPGA连载43:DDR控制器集成与读写测试之DDR2引脚电平设... attach_img
2016-11-3 17:53 0 909
[FPGA] 例说FPGA连载42:DDR控制器集成与读写测试之DDR2 IP核接口时序 attach_img
2016-11-3 17:14 0 997
[FPGA] ISE uart_baud_gen.v attach_img
2016-11-1 10:49 0 732
[CPLD] 关于ALTERA CPLD MAX3000A EPM3064ATC44-10的功耗
2016-10-31 20:59 0 1330
[FPGA] 这个找不到相关文档 attach_img
2016-10-28 13:45 0 716
[FPGA] 例说FPGA连载41:DDR控制器集成与读写测试之DDR2 IP核接口描述 attach_img
2016-10-27 16:12 0 1338
[FPGA] 请教ALTERA的FPGA什么时候开始使用6输入LUT? 新人帖 attach_img
2016-10-26 11:10 0 997
[FPGA] altera FPGA max10 内置的adc怎么用啊 ?!!?说明书没用啊 新人帖
2016-10-24 16:23 0 1801
请帮忙分析NIOS的串口DMA接收不正常原因
2016-10-20 11:14 0 964
[FPGA] 例说FPGA连载40:DDR控制器集成与读写测试之DDR2控制器IP配置 attach_img
2016-10-19 18:14 0 1168
[FPGA] 善用Vivado工程配置文件xpr快速工程创建 attach_img
2016-10-19 17:40 0 1367
[FPGA] 急求!9054进入不了BIOS 新人帖
2016-10-18 23:26 0 962
[Quartus] device family 新人帖 attach_img
2016-10-18 21:05 0 1038
modelsim新版本是多少?
2016-10-15 11:37 0 1680
[FPGA] 例说FPGA连39:DDR控制器集成与读写测试之FPGA片内RAM设置与.. attach_img
2016-10-14 17:46 0 1168
[FPGA] FPGA有什么好的进阶教程
2016-10-14 16:46 0 927
[FPGA] vivado中net的conflict和unrouted有什么不同?
2016-10-13 15:04 0 1536
[FPGA] 例说FPGA连载38:DDR控制器集成与读写测试之FPGA片内RAM概述 attach_img
2016-10-12 17:02 0 976
[FPGA] 使用FPGA时钟展频技术搞定RE测试 attach_img
2016-10-11 17:16 0 1151
[VHDL] VHDL generate语句 新人帖
2016-10-10 22:28 0 1189
例说FPGA37:DDR控制器集成读写测试之FPGA片内存储器概述 attach_img
2016-10-10 16:51 0 968
[FPGA] 例说FPGA连载36:DDR控制器集成与读写测试之功能概述 attach_img
2016-10-8 16:50 0 756
[FPGA] 求助~~~~~~~~~板子时钟调试出现问题
2016-10-8 13:58 0 771
[FPGA] SPartan 6 XC6SLX45 能不能做Display port V1.1?
2016-10-8 11:21 0 1169
[Quartus] 帮助不能正常使用 新人帖
2016-10-7 16:28 0 1268
[FPGA] 例说FPGA连载35:PLL例化配置与LED之闲置引脚设置 attach_img
2016-10-6 16:43 0 1073
[FPGA] FPGA输出32.768 时钟,硬件PCB是否需要做包地处理。
2016-9-30 08:26 0 916
[FPGA] spartan6 spi配置模式下的烧写失败 新人帖
2016-9-27 21:18 0 1538
[FPGA] LED-PWM调制 attach_img
2016-9-24 08:55 0 890
[FPGA] 例说FPGA连载34:PLL例化配置与LED之使用TCL Scripts进行引脚分配 attach_img
2016-9-23 09:11 0 834
[FPGA] NIOS II .S源文件语法请教
2016-9-22 21:08 0 1006
[FPGA] 关于差分输入串行数据处理后输出的问题 新人帖
2016-9-19 20:55 0 770
[FPGA] 关于FPGA在视频处理方面应用 新人帖
2016-9-19 20:15 0 715
[FPGA] 例说FPGA连载33:PLL例化配置与LED之使用Tcl Console进行引脚分配 attach_img
2016-9-17 17:36 0 898
锆石科技A4开发板到了,上贴庆祝一下
2016-9-16 19:14 0 1633
[FPGA] 例说FPGA连载32:PLL例化配置与LED之使用Pin Planner进行引脚分配 attach_img
2016-9-14 16:36 0 888
[FPGA] 例说FPGA连载31:PLL例化配置与LED之PLL的IP核配置 attach_img
2016-9-12 17:03 0 903
[FPGA] Synplify pro综合结果作为ISE/Vivado的输入?
2016-9-10 01:52 0 2246
[FPGA] 例说FPGA连载30:PLL例化配置与LED之功能概述 attach_img
2016-9-9 18:11 0 719
[modelsim] 求帮忙解决。 新人帖
2016-9-7 20:59 0 909
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