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[verilog] 在读写ddr2的时候,DQS信号怎么用,可不可以不用
2014-9-18 23:03 4 2695
用FPGA做FFT,是否一定需要高数基础才行。
2014-9-18 16:48 6 2428
spi flash双速率读取求解
2014-9-17 22:29 0 930
[FPGA] dsp的flash上电不加载
2014-9-17 22:18 0 1141
[Quartus] quartus 13.1字符串快速输入
2014-9-17 14:33 1 1373
再发一帖求助,50分求助,还是这个蛋疼的JTAG接口,Altera的
2014-9-17 14:30 5 2282
[FPGA] FPGA和TMS320C6455之间的通信
2014-9-17 13:47 1 1079
timequest 中set input delay ,set output delay,怎么设置
2014-9-17 13:41 0 1751
[FPGA] 最近找工作,比较迷茫,求指点
2014-9-17 12:18 8 1729
成功解决FPGA设计时序问题的三大要点
2014-9-16 22:36 14 2325
[FPGA] 《自己动手写CPU》下载 attachment
2014-9-15 19:53 1 1157
[FPGA] fifo设计
2014-9-13 10:32 0 803
[verilog] 基于FPGA的示波器图文显示系统的设计方案
2014-9-12 11:46 4 2673
[verilog] 我与赛灵思的2012+菜鸟也分享
2014-9-12 11:44 18 3286
[verilog] 基于FPGA实现的可复用通信接口设计
2014-9-12 11:43 4 2912
[verilog] 自定义ram问题
2014-9-12 11:24 5 4060
[FPGA] 如何修正时序约束中slack为负的问题 attach_img
2014-9-11 21:41 3 2427
赛灵思领域专用目标设计平台背景介绍
2014-9-11 17:43 1 1317
Proteus 与单片机实时动态仿真
2014-9-11 16:53 14 10610
设计技巧:基于赛灵思Spartan-3A DSP的安全视频分析
2014-9-11 16:52 3 1768
iccavr 和avr studio安装调试总结 attach_img
2014-9-11 16:51 1 3269
基于EDK的FPGA算法开发总结
2014-9-11 15:45 3 2716
[verilog] 帮忙看看,新手
2014-9-10 17:57 2 1190
RapidIO设备如何获取整个RapidIO网络中的其他节点deviceID?
2014-9-9 18:21 10 3168
Aurora ,Rapidio和GTP是什么关系
2014-9-9 18:19 2 2599
[FPGA] 急求!急需做一款FPGA软件。
2014-9-8 15:38 3 1421
[FPGA] [原创课程] 基于FPGA的SDRAM接口设计 attach_img  ...2
2014-9-7 16:55 20 3414
讨论:FPGA供电电源芯片的选择?  ...2
2014-9-6 22:57 20 7812
[CPLD] FPGA学习视频与君共勉  ...2
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[VHDL] xilinx ML507开发板的原理图 attachment  ...2
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[Quartus] IP核应用 attachment
2014-9-4 19:33 2 2051
欢迎入门级FPGA/CPLD开发者共享自己的经验及成果
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[verilog] always中的if语句判断出问题
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[FPGA] FPGA和CPLD通用的问题
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quartus2报警问题
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FPGA 片间通信问题
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[FPGA] 如何估算电流功耗
2014-9-2 11:59 3 2142
[FPGA] Verilog和VHDL的问题
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[Quartus] 请教一下这是什么错误
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[Quartus] 如何产生差分时钟输出?
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