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今日: 0|主题: 14355|帖子: 104807

一个3-8译码器芯片大概用几个LUT和几个flip-flop
2013-8-26 17:38 5 2365
v6设置clocking
2013-8-26 16:26 0 1525
设置clocking wizard
2013-8-26 16:23 0 1256
求指导!!!
2013-8-26 13:34 1 1224
谁用altera,来试试下面的代码  ...2
2013-8-26 13:28 20 3297
“光立方”(视频)
2013-8-26 12:22 12 3505
ise3.4中怎么没有V6 DCM ip核 attach_img
2013-8-26 10:43 5 1722
[verilog] 高手们是怎么使用并行思想去设计模块的?
2013-8-26 06:12 9 2213
哪位有Xilinx Sp605开发板
2013-8-25 22:06 6 1908
求Quartus12.1的PCI和谐码
2013-8-25 22:02 0 1511
FFT变换的到的不是频谱,怎么转换成频谱? attach_img
2013-8-25 21:49 15 2850
Spartan-6开发板
2013-8-25 21:43 16 1945
[FPGA] modelsim仿真一直在Loading,也不报错,怎么弄啊?
2013-8-25 13:40 5 4692
如何让FPGA画圆
2013-8-25 00:05 10 3291
cupl语言实现分频
2013-8-25 00:04 2 1586
FPGA能否软件复位?
2013-8-25 00:03 15 3940
[FPGA] verilog 语言写ad822的采集用大dac900回放 attach_img
2013-8-24 10:27 4 2002
关于zynq启动的问题,求达人解答!
2013-8-23 23:22 1 1490
MAX3000和EX64用哪个好?
2013-8-23 23:21 1 1051
[FPGA] 求教下IP核怎么设置啊?
2013-8-23 18:51 2 1730
[FPGA] FPGA板子焊接问题
2013-8-23 16:00 0 1640
【求助】硬件实现协议卸载
2013-8-22 21:27 1 1353
chipscope触发条件设置 attachment
2013-8-22 21:18 14 7192
spartan6和virtex6开发难度一样吗
2013-8-22 21:09 4 2235
Microblaze 从 UART 接收数据例程
2013-8-22 19:31 1 3889
【求助】硬件实现协议卸载
2013-8-22 15:24 1 1166
quartus ii 11.0的toggle rate在哪里设置?
2013-8-22 10:56 0 2527
rom 查找表
2013-8-21 22:16 3 1688
PCIE core的ucf约束文件
2013-8-21 14:53 3 2348
关于DDR2的布线
2013-8-20 22:13 4 2823
[FPGA] FPGA问题(这标题) attach_img
2013-8-20 19:57 2 1595
[FPGA] FPGA实现等效采样的时钟问题
2013-8-20 19:47 0 1451
怎么知道xilinx库函数中包括哪些component?
2013-8-20 15:08 0 1346
[FPGA] FPGA是什么?FPGA现状?怎样学习FPGA?
2013-8-20 15:04 2 1860
FPGA是什么?FPGA现状?怎样学习FPGA?
2013-8-20 10:31 0 1254
[CPLD] 请教廉价CPLD实现I2C的方案
2013-8-20 08:30 6 2310
[modelsim] 用ise14.2的几个错误怎么解决
2013-8-20 08:17 2 4105
[FPGA] Fpga低温出现故障,部分逻辑出现异常
2013-8-20 08:13 5 5027
[FPGA] altera ddr ip的问题,cyclone4是否不支持ddr sdram的ip? attachment
2013-8-20 08:11 3 2416
求基于FPGA的(DDS)任意信号发生器????
2013-8-20 08:10 3 2374
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