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求SDK中用xilinx system C编写的AD0809程序 sdk System XILINX mentoscui 2013-1-2 18:36 6 2129
视频：如何在设计中插入调试内核调试内核 UG GoldSunMonkey 2013-1-2 18:22 17 2324
关于cpld的倍频问题 PLD 倍频 ywert000 2013-1-2 18:21 4 2805
遇到了一个奇怪的问题，请高手们指教信号时钟晶振 wrigleymint 2013-1-2 18:19 6 2132
给程序挑错 ST ic mentoscui 2013-1-2 18:18 4 1410
这是什么情况？怎么结贴给分啊？ zhpg009 2013-1-2 18:17 3 1218
不关心的值怎么处理 hechnology 2013-1-2 18:08 1 1552
谁可以帮忙解释一下FPGA上载方面的问题 FPGA flash 硬件 robbins37 2013-1-2 18:03 7 1769
Xilinx FPGA 电路配置(转) FPGA XILINX 电路配置 xlhtracy 2013-1-2 18:01 9 4637
Error: Can't place node CAN ce AC zhl100 2013-1-2 14:20 6 3040
新年好，请大侠帮我个忙，把寄存器的数据保存到文档。 ST TE sahh 2013-1-2 11:44 1 2085
模块例化端口问题端口 Output TPU ywert000 2013-1-1 23:59 4 1820
[FPGA] 很便宜的一个视频开发板开发板 DRAM 工程师 feihufuture 2013-1-1 23:58 5 2189
《从零开始走进FPGA世界》下载！ ...2 3 4 5 6 FPGA PGA AC logokfu 2013-1-1 21:31 105 15252
视频：Verifying your Vivado HLS Design Design Vivado ST GoldSunMonkey 2013-1-1 12:39 17 2553
[VHDL] Virtex-5 2 byte, single lane GTP Aurora(2位单通道GTP Aurora)实例 ...2 LAN single Virtex-5 SuperX-man 2012-12-31 22:20 32 6996
解决ModelSim显示中文乱码 modelsim ce FOR weishukongji 2012-12-31 21:55 2 5932
赛灵思多模无线电目标设计平台详解赛灵思多模星星之火红 2012-12-31 19:56 11 2087
有关赛灵思基于ARM处理器处理架构的16个疑问 ...2 ARM处理器赛灵思嵌入式 xiao6666 2012-12-31 19:04 27 3302
跪求FPGA开发板的资料 FPGA PGA 开发板 lonerwolf 2012-12-31 18:55 3 2100
视频：Vivado设计套件的消息、报告、日志功能演示 Vivado vi AD GoldSunMonkey 2012-12-31 16:42 11 1988
转帖：Matlab中FDATool工具箱的滤波器设计及相关文件的生成滤波器设计 matlab FDAtool GoldSunMonkey 2012-12-31 16:37 9 6063
在FPGA中，如果进行时序约束 FPGA PGA 时序 mentoscui 2012-12-31 16:34 6 2172
求选型选型 xc6slx9 lonerwolf 2012-12-31 09:05 2 2741
自己写的johnson计数器出问题了 Johnson 计数器 RS robbins37 2012-12-30 22:31 2 2179
当有需要上升沿触发要怎么处理触发信号 Pulse robbins37 2012-12-30 22:30 2 1755
一个二进制转BCD的问题，请大家分析 BCD 二进制 ge qwempty 2012-12-30 22:16 2 2160
串口问题几个疑问串口异步通信 qwempty 2012-12-30 22:13 2 1900
我得cmd有什么问题，请大家看看？ ge length qwempty 2012-12-30 22:13 2 1180
发个帖子吐个槽，问题找到了。蛋疼的赛灵思，蛋疼的ISE se 赛灵思接口水畔天蓝 2012-12-30 21:50 8 1742
Modesim错误 esim modes 仿真 ywert000 2012-12-30 21:47 1 2605
从EPCS加裁NIOS NIOS contro ywert000 2012-12-30 21:37 1 1737
[matlab] 求助FPGA中的条件编译问题 FPGA 编译 sd King8017 2012-12-30 21:27 5 2157
关于signal tap ii的问题 SIGNAL 信号 API weishukongji 2012-12-30 21:01 1 1560
所有的register都为unconstrained register Constrained AD dousfoulexd 2012-12-30 19:15 1 1883
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为何选择Zynq-7000 All Programmable SoC Programmable SOC Zynq-7000 GoldSunMonkey 2012-12-29 23:22 6 1886

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