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求助IP核生成的fifo控制问题.. FIFO ip核控制 mxjtracy 2012-7-18 20:29 6 3190
[Quartus] 利用以太网硬件在环路实现高带宽DSP仿真方案高带宽以太网梅花望青竹 2012-7-18 19:12 1 2335
征战友，最近在准备28nm FPGA的大赛，有没有大神支持一把！ ...2 FPGA 大赛 ARM baicicib 2012-7-18 17:04 30 5190
下面的电路，testbench如何写 testbench 电路 LED 小鱼儿1045 2012-7-18 15:33 16 3438
求助fifo ip核的问题 FIFO ip核信号 mxjtracy 2012-7-18 15:14 14 4318
[VHDL] virtex5 并行FLASH配置 flash virtex IMPACT sihai90 2012-7-18 14:43 4 2403
[CPLD] 请问，为什么fifo的写入会出问题？ FIFO gaochy1126 2012-7-18 14:37 7 2982
用verilog来模拟eeprom的读写功能 EEPROM verilog 模拟 yuhaijian112 2012-7-17 23:54 2 2511
[CPLD] 有谁用过XILINX FIFO IP核啊！ ...2 FIFO ip核 XILINX seavend0603 2012-7-17 21:57 20 10827
异步FIFO结构及FPGA设计 FPGA设计 fifo结构 joker319 2012-7-17 21:39 4 2267
[CPLD] FPGA集成数据缓冲器与分离FIFO或多端口存储器的比较存储器缓冲器集成 gaochy1126 2012-7-17 19:23 2 2155
[CPLD] 如何用FPGA实现嵌入式系统 FPGA实现嵌入式系统处理器 gaochy1126 2012-7-17 19:17 5 2013
Virtex-7 PCI Express Gen3演示视频 Express Gen PCI SuperX-man 2012-7-17 18:55 2 2243
[CPLD] FIFO FIFO 读写时钟梅花望青竹 2012-7-17 18:53 10 3414
[Quartus] 基于FPGA的存储测试系统的设计测试系统 FPGA 信号 gaochy1126 2012-7-17 18:49 1 1901
[CPLD] 使用Xilinx的Spartan-6 FPGA作DDR芯片测试 XILINX Spartan-6 FPGA gaochy1126 2012-7-17 18:47 0 2289
时序模块之always语句时序 ge edge wzt19910506 2012-7-17 17:20 15 7775
复位诀窍：考虑局部而非全局全局复位局部捡漏王子 2012-7-17 15:42 17 3508
有没有从orcad原理图自动提取UCF文件的软件？ OrCAD 原理图软件 cobraking 2012-7-17 13:13 10 4228
LATTICE公司的ISP应用软件哪里有下载啊应用软件 ISP lattice zdtdl 2012-7-17 10:00 8 4091
数据匹配问题 AD cuianbin 2012-7-17 09:13 3 2003
【求助】这个程序怎么改？？ ge ST edge 夏沫沫1112 2012-7-16 22:31 6 2248
请问fpga设计的串口一定时间后输出全是0的原因 FPGA设计串口 gaochy1126 2012-7-16 21:01 9 2719
用verilog来模拟eeprom的读写功能 EEPROM verilog 模拟 yuhaijian112 2012-7-16 15:43 0 2192
约束问题 TI Timing ST 403464238 2012-7-16 15:25 4 2468
spartan6的serial rapidIO 的IP有人用过米有？ ip RapidIO Serial lelee007 2012-7-16 13:39 8 4145
[verilog] 什么时间能买到ZYNQ的IC? zynq ic 开发板 and 2012-7-16 13:22 19 3667
用FPGA做采样率为10MSPS的板子，两层板可以搞定吗？ FPGA PGA ps cuianbin 2012-7-15 17:36 6 2230
[Quartus] Spartan-6 LX9 MicroBoard上的 Atmel AT90USB162 ATMEL USB Micro cen00 2012-7-15 17:33 7 2830
如何用verilog语言实现localbus总线时序总线时序 baisen 2012-7-15 17:33 2 5924
[CPLD] 基于FPGA的FIR滤波器的实现 fir滤波器 FPGA 函数 gaochy1126 2012-7-13 16:14 13 3549
[CPLD] 3DES算法的FPGA高速实现 des FPGA 梅花望青竹 2012-7-13 16:10 2 1642
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