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[FPGA] 这个找不到相关文档 attach_img
2016-10-28 13:45 0 657
[FPGA] 例说FPGA连载41:DDR控制器集成与读写测试之DDR2 IP核接口描述 attach_img
2016-10-27 16:12 0 1210
[FPGA] 请教ALTERA的FPGA什么时候开始使用6输入LUT? 新人帖 attach_img
2016-10-26 11:10 0 915
Verilog调用vhdl代码,参数传不进去!!! attach_img
2016-10-25 22:04 3 1621
[VHDL] 不明白老板为啥不让用variable,一个进程只许一个赋值语句
2016-10-25 22:02 5 1687
[CPLD] 利用Lattice的CPLD实现电平转换
2016-10-25 14:26 7 3272
[CPLD] 求教关于CPLD IO口对电压识别的问题 新人帖 attach_img
2016-10-24 22:18 1 1061
[FPGA] altera FPGA max10 内置的adc怎么用啊 ?!!?说明书没用啊 新人帖
2016-10-24 16:23 0 1744
[FPGA] 研发设计就是人生阅历
2016-10-23 13:19 4 1560
请帮忙分析NIOS的串口DMA接收不正常原因
2016-10-20 11:14 0 890
[FPGA] FPGA某个引脚输出电压为1.66V,不是3.3V attach_img
2016-10-19 20:00 8 2274
[FPGA] 例说FPGA连载40:DDR控制器集成与读写测试之DDR2控制器IP配置 attach_img
2016-10-19 18:14 0 1041
[FPGA] 善用Vivado工程配置文件xpr快速工程创建 attach_img
2016-10-19 17:40 0 1283
[FPGA] 急求!9054进入不了BIOS 新人帖
2016-10-18 23:26 0 878
[Quartus] device family 新人帖 attach_img
2016-10-18 21:05 0 927
[FPGA] 菜鸟第一次用FPGA,请教各位前辈几个基本的问题,急急急~ attachment
2016-10-18 16:32 2 1205
怎样检测最后一个脉冲 attach_img
2016-10-16 11:56 11 1331
modelsim新版本是多少?
2016-10-15 11:37 0 1566
[Quartus] 有人知道这是为什么 吗? attach_img
2016-10-15 11:33 1 1177
[FPGA] 例说FPGA连39:DDR控制器集成与读写测试之FPGA片内RAM设置与.. attach_img
2016-10-14 17:46 0 986
[FPGA] FPGA有什么好的进阶教程
2016-10-14 16:46 0 865
[FPGA] vivado中net的conflict和unrouted有什么不同?
2016-10-13 15:04 0 1432
关于DM9000CEP问题
2016-10-12 17:43 11 1931
[FPGA] 例说FPGA连载38:DDR控制器集成与读写测试之FPGA片内RAM概述 attach_img
2016-10-12 17:02 0 841
[verilog] 求解释SPI代码,有几点不明白 attach_img
2016-10-12 11:11 4 3775
[FPGA] 请问这两句话是如何实现移位的。
2016-10-11 23:01 5 1580
[FPGA] 使用FPGA时钟展频技术搞定RE测试 attach_img
2016-10-11 17:16 0 1044
[FPGA] Altera FPGA Fifo使用遇问题
2016-10-11 11:34 2 1022
[VHDL] VHDL generate语句 新人帖
2016-10-10 22:28 0 1118
例说FPGA37:DDR控制器集成读写测试之FPGA片内存储器概述 attach_img
2016-10-10 16:51 0 851
自己做了个FPGA板子 调试的时候发现了一些问题 新人帖
2016-10-10 12:56 2 935
[FPGA] virtex5 DDR2调试求教 attachment
2016-10-9 14:11 4 865
[FPGA] 例说FPGA连载36:DDR控制器集成与读写测试之功能概述 attach_img
2016-10-8 16:50 0 661
[FPGA] 多块FPGA 信号采集板时钟同步 新人帖 attach_img
2016-10-8 15:57 2 1921
[FPGA] 求助~~~~~~~~~板子时钟调试出现问题
2016-10-8 13:58 0 706
[FPGA] SPartan 6 XC6SLX45 能不能做Display port V1.1?
2016-10-8 11:21 0 1085
[FPGA] 自己用纯verilog 写的俄罗斯方块,有很多问题,求大神指导
2016-10-7 19:04 4 2921
[Quartus] 帮助不能正常使用 新人帖
2016-10-7 16:28 0 1147
[FPGA] 例说FPGA连载35:PLL例化配置与LED之闲置引脚设置 attach_img
2016-10-6 16:43 0 915
CPLD(EPM240)+SDRAM 控制OV5640的500w像素拍摄方案,任何单片机可用
2016-10-3 14:10 17 5444
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