收藏本版 |订阅

今日: 1|主题: 14373|帖子: 104883

[FPGA] FPGA某个引脚输出电压为1.66V,不是3.3V attach_img
2016-10-19 20:00 8 2475
[FPGA] 例说FPGA连载40:DDR控制器集成与读写测试之DDR2控制器IP配置 attach_img
2016-10-19 18:14 0 1176
[FPGA] 善用Vivado工程配置文件xpr快速工程创建 attach_img
2016-10-19 17:40 0 1374
[FPGA] 急求!9054进入不了BIOS 新人帖
2016-10-18 23:26 0 968
[Quartus] device family 新人帖 attach_img
2016-10-18 21:05 0 1048
[FPGA] 菜鸟第一次用FPGA,请教各位前辈几个基本的问题,急急急~ attachment
2016-10-18 16:32 2 1338
怎样检测最后一个脉冲 attach_img
2016-10-16 11:56 11 1593
modelsim新版本是多少?
2016-10-15 11:37 0 1683
[Quartus] 有人知道这是为什么 吗? attach_img
2016-10-15 11:33 1 1286
[FPGA] 例说FPGA连39:DDR控制器集成与读写测试之FPGA片内RAM设置与.. attach_img
2016-10-14 17:46 0 1170
[FPGA] FPGA有什么好的进阶教程
2016-10-14 16:46 0 931
[FPGA] vivado中net的conflict和unrouted有什么不同?
2016-10-13 15:04 0 1539
关于DM9000CEP问题
2016-10-12 17:43 11 2073
[FPGA] 例说FPGA连载38:DDR控制器集成与读写测试之FPGA片内RAM概述 attach_img
2016-10-12 17:02 0 984
[verilog] 求解释SPI代码,有几点不明白 attach_img
2016-10-12 11:11 4 4021
[FPGA] 请问这两句话是如何实现移位的。
2016-10-11 23:01 5 1715
[FPGA] 使用FPGA时钟展频技术搞定RE测试 attach_img
2016-10-11 17:16 0 1164
[FPGA] Altera FPGA Fifo使用遇问题
2016-10-11 11:34 2 1113
[VHDL] VHDL generate语句 新人帖
2016-10-10 22:28 0 1189
例说FPGA37:DDR控制器集成读写测试之FPGA片内存储器概述 attach_img
2016-10-10 16:51 0 975
自己做了个FPGA板子 调试的时候发现了一些问题 新人帖
2016-10-10 12:56 2 1058
[FPGA] virtex5 DDR2调试求教 attachment
2016-10-9 14:11 4 988
[FPGA] 例说FPGA连载36:DDR控制器集成与读写测试之功能概述 attach_img
2016-10-8 16:50 0 762
[FPGA] 多块FPGA 信号采集板时钟同步 新人帖 attach_img
2016-10-8 15:57 2 2072
[FPGA] 求助~~~~~~~~~板子时钟调试出现问题
2016-10-8 13:58 0 774
[FPGA] SPartan 6 XC6SLX45 能不能做Display port V1.1?
2016-10-8 11:21 0 1179
[FPGA] 自己用纯verilog 写的俄罗斯方块,有很多问题,求大神指导
2016-10-7 19:04 4 3115
[Quartus] 帮助不能正常使用 新人帖
2016-10-7 16:28 0 1276
[FPGA] 例说FPGA连载35:PLL例化配置与LED之闲置引脚设置 attach_img
2016-10-6 16:43 0 1082
CPLD(EPM240)+SDRAM 控制OV5640的500w像素拍摄方案,任何单片机可用
2016-10-3 14:10 17 5945
[FPGA] FPGA输出32.768 时钟,硬件PCB是否需要做包地处理。
2016-9-30 08:26 0 916
[FPGA] FPGA管脚电压部分不对 新人帖
2016-9-28 22:52 2 1475
[FPGA] spartan6 spi配置模式下的烧写失败 新人帖
2016-9-27 21:18 0 1546
[FPGA] Lattice FPGA项目开发外发 新人帖
2016-9-27 00:37 5 2094
[FPGA] [锆石科技]收到活动的板子了,晒晒! 新人帖 attach_img
2016-9-25 08:40 14 2176
[FPGA] LED-PWM调制 attach_img
2016-9-24 08:55 0 892
[FPGA] 例说FPGA连载34:PLL例化配置与LED之使用TCL Scripts进行引脚分配 attach_img
2016-9-23 09:11 0 842
[FPGA] NIOS II .S源文件语法请教
2016-9-22 21:08 0 1008
[FPGA] 求助:自己设计的FPGA板子无法进行JTAG下载 新人帖 attach_img
2016-9-22 16:09 17 4692
[FPGA] 用microblaze的axi结构时,网表正常生成,但是产生bit文件出错 新人帖
2016-9-21 22:37 3 1450
下一页 »

快速发帖

还可输入 80 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

在线客服 返回版块 返回顶部