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[ZLG-MCU]

关于GPIO Open Drain

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kilby|  楼主 | 2008-8-12 23:33 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
GPIO, pen, AI, 电平, 接口
由于LM3S811高电平输出为3.3V，而外设需要5V的接口，我考虑使用open drain，但是实验结果却不尽人意。

我分别尝试上拉电阻的阻值为1k，3.3k，10k，对应的输出低电平分别为0.58v，0.12v，0.05v，输出的高电平分别为4.2v, 4.0v, 3.87v。虽然我最终选了3.3v来与外设接口并可以成功实现通讯，我想知道的是，有无可能通过选取合适的电阻和内部设定，使接口可以低电平输出小于0.1v，而高电平输出高于4.5v？

不知大家有无可靠的方案？（电平转换芯片就不用提醒了）

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