如何保护射频采样ADC的输入？

只看该作者 · 2015-9-11 15:13

本文转自ADI技术杂志《模拟对话》https://ezchina.analog.com/message/28501#28501

任何高性能ADC，尤其是射频采样ADC，输入或前端的设计对于实现所需的系统级性能而言很关键。很多情况下，射频采样ADC可以对几百MHz的信号带宽进行数字量化。前端可以是有源（使用放大器）也可以是无源（使用变压器或巴伦），具体取决于系统要求。无论哪种情况，都必须谨慎选择元器件，以便实现在目标频段的最优ADC性能。

简介

射频采样ADC采用深亚微米CMOS工艺技术制造，并且半导体器件的物理特性表明较小的晶体管尺寸支持的最大电压也较低。因此，在数据手册中规定的出于可靠性原因而不应超出的绝对最大电压，将当前主流的射频采样ADC与之前的老器件相比，可以发现这个电压值是变小的。

在使用ADC对输入信号进行数字量化的接收机应用中，系统设计人员必须密切关注绝对最大输入电压。该参数直接影响ADC的使用寿命和可靠性。不可靠的ADC可能导致整个无线电系统无法使用，且更换成本也许非常巨大。

为了抵消过压带来的风险，射频采样ADC集成了可以检测高电平阈值的电路，允许接收机通过自动增益控制(AGC)环路调节增益来进行补偿。但是，如果采用流水线型ADC，则与架构相关的固有延迟可能导致输入暴露于高电平之下，从而可能损害ADC输入。本文讨论了一种简单的方法来增强AGC环路，保护ADC。

输入架构

射频采样ADC可采用多种不同的设计，最常见的一种是流水线架构，该架构采用多级级联，将模拟信号转换为数字信号。第一级最重要，可以是缓冲或未缓冲级。选择哪种设计取决于设计要求和性能目标。例如，一个带缓冲器的ADC通常在频率范围内具有更好的SFDR性能，但功耗比不带缓冲器的ADC更高。

前端设计同样会根据ADC是否有缓冲级而改变。没有缓冲器的ADC需要使用额外的串联电阻来处理输入电荷反冲，它同样会改善SFDR性能。图1和图2显示了AD9625未缓冲和AD9680缓冲射频采样ADC的等效输入电路简化图。为简明起见，仅显示单端输入。

图1. 未缓冲射频采样ADC输入的等效电路

图2. 缓冲射频采样ADC输入的等效电路

无论采用何种架构，ADC输入端可持续的绝对最大电压由MOSFET能够处理的电压决定。缓冲输入更复杂，且比未缓冲输入功耗更大。ADC具有多种不同类型的缓冲器，最常见的一种是源极跟随器。

故障机制

缓冲和未缓冲ADC的故障机制有所不同，但通常是在超出允许的最大栅极-源极电压( (VGS))或漏极-源极电压((VDS))时发生故障。这些电压如图3所示。

图3. MOS晶体管的关键电压

例如，假设VDS超过允许的最大电压，则发生VDS击穿故障，这通常在MOSFET处于关断状态且在漏极施加了相对于源极的过量电压时发生。如果VGS超过允许的最大电压，则它会导致VGS击穿（亦称为氧化层击穿）。这通常在MOSFET处于导通状态且在栅极施加了相对于源极的过量电压时发生。

未缓冲ADC的故障机制

图4显示的是一个未缓冲ADC输入。采样过程由反相时钟信号Φ和Φ控制，它们是MOSFET M1的采样/保持信号以及MOSFET M2的复位信号。M1导通时，M2关断，且电容CSW跟踪信号（采样或跟踪模式）。当M1关断时，MDAC中的比较器作出判断后M2导通，电容CSW复位。这样可在采样阶段使采样电容为下一次采样做好准备。该电路通常工作状态优良。

但是，高压输入使M2暴露在超出其漏源电压的应力之下。当对输入高压进行采样（M1导通、M2关断）时，M2会暴露于较大的VDS之下，其在不足采样时钟半周期的时间内处于关断状态，但哪怕只是瞬时的暴露也会降低电路的可靠性，导致ADC随时间失效。在复位模式下（M1关断、M2导通），因M1的漏极上有输入信号，从而也会暴露于大的VDS电压。

图4. 未缓冲ADC输入的故障模式

缓冲ADC的故障机制

图5显示的是一个缓冲ADC输入。采样和复位信号适用相同的时钟方案。无论相位如何，当缓冲器M3栅极暴露于高压输入时，产生电流I1以及I2。电流源I1采用PMOS晶体管实现，而I2采用NMOS晶体管实现。M3栅极上的高电压导致I1和I2 MOSFET产生过大的VDS。此外，M3栅极上的高电压还可导致氧化层击穿。

图5. 缓冲ADC输入的故障模式

缓冲和未缓冲ADC的击穿机制有所不同，因此绝对最大输入电压同样有所不同，如表1所以。

表1. 缓冲与未缓冲ADC的绝对最大值规格

ADC	工艺 (nm)	输入结构	绝对最大输入电压(V)	差分摆幅 (V p-p)
14位 105 MSPS	350	缓冲	7	9.2
14位 125 MSPS	180	未缓冲	2.0	4.5
16位 250 MSPS	180	缓冲	3.6	6.0
12位 2.5 GSPS	65	未缓冲	1.52	4
14位 1.0 GSPS	65	缓冲	3.2	4.6

使用TVS二极管保护ADC输入

有几种方式可以保护ADC输入不受高压影响。部分ADC（特别是射频采样ADC）具有内置电路，可以检测输入电压并在超过设定阈值时进行上报。如数据手册中所述，该快速检测输出存在一些延迟，因此依然会使ADC输入端短时间内暴漏于高压之下。

瞬态电压稳定器(TVS)二极管可以限制过量电压，但会在正常工作期间影响ADC性能。图6显示的是一个使用TVS二极管的过压保护电路。

图6. 带TVS二极管保护的ADC前端电路

虽然TVS二极管通过箝位过量电压保护ADC输入，但它们会极大地恶化谐波性能。图7显示了具有30 MHz、–1 dBFS输入的14位、250 MSPS无缓冲ADC的前端带与不带TVS二极管时的FFT比较情况。

图7. 带与不带TVS二极管保护的ADC前端电路FFT比较

TVS二极管会极大地恶化奇次谐波性能，因为它们在不作用为箝位的时候就相当于一反向偏置二极管。该PN二极管具有结电容CJ0，该电容与ADC内部开关动作产生的非线性反冲电流互相作用，产生一个与模拟输入信号混合的电压信号。该混合信号在ADC内部被采样，产生极大的三次谐波。在过压条件下的时域曲线（图8）显示了TVS二极管的箝位削压的功能。这并不表示TVS二极管不适合用来保护ADC输入，只是必须仔细考虑二极管规格，以便达到性能要求。选择二极管类型及其参数时必须作更全面的考虑。

图8. 前端电路中的TVS二极管保护导致削波信号

使用肖特基二极管保护射频采样ADC输入

当带宽和采样速率达到GHz和GSPS级别时，射频采样ADC可以简化无线电接收机设计，因为它们不需要ADC前具有很多的混频级，但这样会让ADC输入易受过压应力影响。图9显示的是用于射频采样ADC的典型前端设计，采用放大器驱动。新一代放大器专为与这些ADC实现接口而设计，具有快速攻击响应输入管教，可通过串行外设接口(SPI)配置，将输出衰减为预定增益。快速攻击响应引脚可以配置为响应射频采样ADC的快速检测输出。ADA4961是具有快速攻击响应功能的新一代放大器实例。AD9680和AD9625是具有快速检测功能的射频采样ADC实例。

图9. 带快速攻击响应功能的放大器驱动带快速检测功能的射频采样ADC

只要输入电压处于合理的范围之内，图9中的拓扑便能工作良好。举例而言，假如该接收机的输入端收到突发高压信号，则放大器的输出将上升至放大器电源轨的电压水平（本例中为5 V）。这将产生巨大的电压摆幅，超过ADC输入端的绝对最大额定电压。快速检测功能存在一定延迟（AD9680-1000为28个时钟周期或28 ns），因此等到快速检测逻辑输出告诉放大器置位快速攻击响应时，ADC早已暴露在高压下数个时钟周期。这可能降低ADC的可靠性，因此无法承受这种风险的系统设计必须采用第二保护模式。具有极低器件和寄生电容的快速响应肖特基二极管在这种情况下十分管用。特定二极管的关键参数可参见数据手册。

反向击穿电压(VBR)——AD9680输入引脚上的最大输入电压——相对于AGND约为3.2 V，因此为该二极管选择数值为3 V的反向击穿电压。

结电容(CJ0)——二极管电容应尽可能低，确保正常工作时二极管不影响ADC的交流性能(SNR/SFDR)。

图10显示的是无源前端，肖特基二极管位于ADC之前。无源前端比较容易演示肖特基二极管在不影响交流性能情况下对ADC输入端的保护。

图10. 显示射频采样ADC和肖特基二极管的无源前端电路

这颗射频采样ADC经过测试可输入高达2 GHz频率的信号，因此选用RF肖特基二极管(RB851Y)。表2显示RB851Y的关键参数；表明该器件适合该应用。测试结果显示二极管防止了ADC输入电压超过其3.2 V的绝对最大电压（相对于AGND）。图11显示的是一个单端输入（ADC的VIN+引脚）暴露在高压之下（185 MHz）的情况。肖特基二极管将电压箝位至3.0 V左右（相对于AGND），防止ADC输入达到3.2 V限值。图12显示的是在肖特基二极管箝位下的AD9680输入端的差分信号。

表2. 用于保护射频采样ADC输入的肖特基二极管关键参数

参数	数值	单位	注释
反向电压(VR)	3	V	AD9680数据手册中，绝对最大额定电压值为VIN± = 3.2 V
端点之间的电容 (CJ0, 或 Ct)	0.8	pF	正常条件下对ADC性能影响较小