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[Actel FPGA]

布线标准?

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沙发
arm-123| | 2009-3-9 09:36 | 只看该作者

从时序仿真中获得的时序信息是基于最坏情况参数的.

因此,通常在硅片上实际操作的结果要比仿真中的好.对于可靠的设计而言, 始终都要考虑最坏的情况.

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板凳
徐若瑄| | 2009-3-10 10:20 | 只看该作者

是不是在高速信号中,信号线长度也很严格!

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地板
linux123| | 2009-3-13 14:31 | 只看该作者

向大家学习了~

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小cat|  楼主 | 2009-3-14 17:55 | 只看该作者

哦。谢谢

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