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[Actel FPGA] 如何用时序逻辑电路和VERILOG分别实现以下的功能？

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 楼主| yhhdsp 发表于 2009-3-29 23:15 | 显示全部楼层 |阅读模式
verilog, 时序逻辑电路, CPU, 信号, 寄存器
如何用时序逻辑电路和VERILOG分别实现以下的功能？<br />1、一个方波信号由低变高进行置位，要求CPU能读到相应位；<br />2、向某一控制寄存器的相应位写1时，清相应位；写0时，不改变。<br />
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usber 发表于 2009-5-9 12:57 | 显示全部楼层

帮顶一下，知道的朋友给解决下

  
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jumpoo 发表于 2009-5-15 14:09 | 显示全部楼层

这个很容易嘛

  
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