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[Actel FPGA]

标准的verilog语法，难道我写错了？？

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楼主
wangkj|  楼主 | 2009-6-3 10:34 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
verilog, VGA, IO, TE, vi

reg[15:0] pixcel_buf[15:0];//16*16 bit refresh tft screen data buffer 

Error: NETLIST:001 Behavioral HDL is not supported. Module vga has behavioral code in FILE E:vga_lcdmini2440verilogVGAh

这可是 verilog的标准语法啊。

altera就没问题。

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沙发
wangkj|  楼主 | 2009-6-3 17:13 | 只看该作者

是软件安装问题，重新安装后正常

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板凳
auzxj| | 2009-6-23 10:07 | 只看该作者

自问自答型

O(∩_∩)O哈哈~

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地板
beinghu| | 2009-7-3 16:25 | 只看该作者

真的是自问自答？？？

verilog语言好多版本的   数组应该是2001版的 
好多工具要自己指定2001版

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