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关于PCB LVDS 传输线上串联磁珠的问题？

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楼主
gaomlin|  楼主 | 2015-10-17 17:40 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
LVDS, PCB, 传输线, 串联, 磁珠
本帖最后由 gaomlin 于 2015-10-17 17:40 编辑

最近做产品，需要用到LVDS，看到以前一块友商的板子上LVDS 驱动板上数据线上靠近连接器的地方串联了磁珠，按理说LVDS信号有200多M，串联磁珠不是直接增加了其传输线阻，会使信号衰减吗，希望各位大神帮忙解答下？
大概是这样



LVDS发射端用的芯片是SN75LVDS83B

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沙发
Ted_Chen| | 2015-10-17 17:43 | 只看该作者
好帖帮顶呐！

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板凳
gaomlin|  楼主 | 2015-10-17 18:02 | 只看该作者
谢谢

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地板
丁弋宇| | 2015-10-18 16:30 | 只看该作者
窃以为此处该上共模电感，譬如MURATA的DLW21xxx
有人可能抄了原理图不明原理，所以把共模电感抄2个独立电感/磁珠
也有可能是为了过EMC测试，而故意串进去衰减的
我还见过有人LVDS串电阻，CLOCK线上并电容的


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5楼
caoenq| | 2015-10-19 10:07 | 只看该作者
因为离连接器较近，是不是为了阻抗匹配，减少信号反射，

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6楼
firefight4321| | 2015-10-19 14:38 | 只看该作者
共模电感

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7楼
sunndas| | 2020-4-30 13:51 | 只看该作者
为了过EMI

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8楼
qingyang235| | 2020-5-6 11:32 | 只看该作者
应该要用共模电感的，但是也有看到用磁珠的。

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9楼
liuasan| | 2020-5-7 11:35 | 只看该作者
应该是共模电感

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10楼
imbean| | 2020-5-18 12:51 | 只看该作者
从图上已经放了共模电感，圈起来的部分楼主可以再确认一下，有可能是0欧电阻；如果确定是磁珠，那可能是为了抑制高次谐波EMI

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11楼
ttgoer| | 2020-7-16 14:14 | 只看该作者
一般是因为EMI原因 ，为了抑制高次谐波

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12楼
shawncheung| | 2020-7-18 14:54 | 只看该作者
ttgoer 发表于 2020-7-16 14:14
一般是因为EMI原因 ，为了抑制高次谐波

遇到楼主同样的情况，也是串的磁珠。。一般是用多大的呢？

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ttgoer 2022-7-8 13:56 回复TA
一般是不使用磁珠的，LVDS信号应该使用信号用的共模电感。 
13楼
kwiewie1988| | 2021-11-15 20:00 | 只看该作者
EMI与SI本身就是一对矛盾体，SI强调信号完整性，尽可能保留谐波成分，EMI强调尽量衰减高频成分，因此，在满足SI条件下，尽可能降低上升时间，满足EMI要求；说回图中，理论上应该是加共模电感的

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评论
ttgoer 2022-7-8 13:58 回复TA
对的。 在处理CLK信号时特别明显，比如为了过传导或辐射加了磁珠， 自由场100V左右就可能出现抖屏或花屏，如果是48V的一般问题不大。 
14楼
szhuang50| | 2022-7-12 16:33 | 只看该作者
看图片更像是差分线加了ESD器件。。。

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15楼
liujt_7| | 2022-11-23 16:32 | 只看该作者
可以拆下来，测量一下

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