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benny169|  楼主 | 2007-1-16 09:14 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

MODULE div455


title 'frequency divider'


    div455    device 'P22V10';

" Inputs

    CLK        pin    1;
" Internal


    S8,S7,S6,S5,S4,S3,S2,S1,S0  pin 22,21,20,19,18,17,16,15,14 istype 'reg';
" Outputs

    DP        pin    23 istype 'reg';
" Constants


         H,L,X,C,Z = 1,0, .X., .C., .Z.;
         Counter = [S8..S0];
         
EQUATIONS
    
        Counter.clk = CLK;    
        when (Counter==511) then DP:=!DP;
        when (Counter==511) then Counter :=57;
        when !CLK then Counter := Counter+1;    
 

END div455

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沙发
guolh| | 2007-1-16 13:33 | 只看该作者

改用verilog吧

改用verilog吧 !

使用特权

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板凳
benny169|  楼主 | 2007-1-17 09:45 | 只看该作者

GAL22V10也能VERILOG编写吗?那就太好了。

用什么编译软件呢?ispVM System支持吗?

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