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请问哪大侠有没有373的verilog程序

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楼主
jack.king|  楼主 | 2009-8-13 20:39 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
verilog, verilog程序, verilo
请问哪大侠有没有373的verilog程序？

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沙发
jack.king|  楼主 | 2009-8-13 21:24 | 只看该作者
请问这个怎么改动下成为74hc373的啊？

module latch090806 (qout,data,clk);
output[7:0] qout;
input[7:0] data;
input clk;
reg[7:0] qout;

always @(clk or data)
begin
if (clk)
qout<=data;
end
endmodule

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板凳
IC_99| | 2009-8-13 22:07 | 只看该作者
不懂

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地板
zjf0000| | 2009-8-14 08:47 | 只看该作者
module latchinf(enable, data, q);

input enable, data;
output q;
reg q;

always @(enable or data)
if (enable)
q <= data;

endmodule

然后配置下引脚就可以了

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