超频到120MHz工作也正常

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 楼主| liuzaiy 发表于 2016-3-1 20:59 | 显示全部楼层 |阅读模式
我的芯片CY8C5868AXI-LP035,原来的工程是60MHz的,现在无意超频到120MHz,工作也是正常的。
yinxiangh 发表于 2016-3-1 21:04 | 显示全部楼层
你是怎么超频的
 楼主| liuzaiy 发表于 2016-3-1 21:06 | 显示全部楼层
利用数字频率输入,实际输入30MHz,文字描述为10MHz,然后经过PLL时,填写40MHz,既倍频了4倍了。
pangb 发表于 2016-3-1 21:08 | 显示全部楼层
用PLL超频到120MHz? 好像只能到67MHz吧
chenjunt 发表于 2016-3-1 21:10 | 显示全部楼层
输入30M是可以的。
ousj 发表于 2016-3-1 21:12 | 显示全部楼层
发你Project上来分享一下?
zyf部长 发表于 2016-3-1 21:15 | 显示全部楼层
cypress的工艺应该不错的。超频玩玩应该有点空间。做产品就不要超频了。
 楼主| liuzaiy 发表于 2016-3-1 21:19 | 显示全部楼层
主要是他作为从机,接口设计为并口,用DMA传输,速度慢,远远小于CYPRESS其他专用SRAM的芯片
juventus9554 发表于 2016-3-1 21:21 | 显示全部楼层
想通过提高时钟,来提高传输速度?
 楼主| liuzaiy 发表于 2016-3-1 21:24 | 显示全部楼层
可以的,上面描述不是清楚了吗?他那个时钟配置,只限制文字描述
小小猫咪 发表于 2016-3-1 21:27 | 显示全部楼层
能举个例子说下嘛
 楼主| liuzaiy 发表于 2016-3-1 21:30 | 显示全部楼层
比如说你接入30MHz,你在文字输入如实写30MHz,你PLL里面填写90MHz,就会错误。但是,你硬件不变,把文字描述,输入的30Mhz改为20MHz,PLL里填写60MHz。这样实际工作就是90MHz了,你可以用示波器看看波形,不过最好分频后,看波形。器件管脚是有频率限制的
kangzj 发表于 2016-3-1 21:31 | 显示全部楼层
哦,就是说芯片主时钟工作在90MHz,CPU也工作在90MHz,这个挺有趣
 楼主| liuzaiy 发表于 2016-3-1 21:34 | 显示全部楼层
这个是可以的。不过也可以分别为MASTER_CLK,BUS_CLK分频的,就像一般的MCU芯片,各部分时钟可以不一样的
houcs 发表于 2016-3-1 21:36 | 显示全部楼层
超频玩下还可以,真正用起来就不大行 了…………
 楼主| liuzaiy 发表于 2016-3-1 21:39 | 显示全部楼层
嗯,我知道了,多谢哈
ioocuo 发表于 2016-3-2 16:11 | 显示全部楼层
楼主有需要LP035吗,可联系我咯
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