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SDRAM布线的走线等长问题

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楼主
herozoujie|  楼主 | 2009-11-2 11:36 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
SDRAM, 布线, 控制, 时钟, RS
普通的SDR SDRAM，133MHz, 地址线，数据线，控制线，时钟线应该如何处理等长？

依据是什么？谢谢大家了

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沙发
duojinian| | 2009-11-3 08:26 | 只看该作者
蛇形走线即可

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板凳
lomeisi_99| | 2009-11-3 14:54 | 只看该作者
我博客里写了点个人的理解，大家批评指正
http://blog.sina.com.cn/s/blog_5fe66f090100fa2s.html

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地板
pk.kong| | 2009-11-3 16:08 | 只看该作者
拿份SDRAM design guide看看。
数据一类，控制+地址一类，时钟，要求不一样。
sdram要求不是很严格。一般问题不大。

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5楼
herozoujie|  楼主 | 2009-11-3 18:57 | 只看该作者
时钟线和数据线组间有等长要求吗?

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6楼
cubasa| | 2009-11-5 15:22 | 只看该作者
要看跑多快的速度，有过失败的经历……不堪回首……
最好还是要等长。

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7楼
herozoujie|  楼主 | 2009-11-6 20:33 | 只看该作者
楼上能否将经验共享?谢谢

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8楼
pk.kong| | 2009-11-6 22:28 | 只看该作者
本帖最后由 pk.kong 于 2009-11-6 22:34 编辑

re：6L
请问sdram最快能跑多快？如果你有过失败经历，估计现在还不明白原因。
全部等长固然可以，这个的耗费多少时间精力，甚至要增加pcb设计费用。
对sdram要求确实不高，控制线和地址线在500mil内，
数据线也是。地址和数据间不用考虑等长问题。
最好是找份设计手册看。

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9楼
holle| | 2009-11-8 12:14 | 只看该作者
楼上指的是否是：
时钟，控制线和地址线走一组，数据线DQM,DQS走一组，组之间长度相差500mil（12.7mm）之内？

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10楼
cubasa| | 2009-11-10 14:52 | 只看该作者
那是我第一次布ARM板，我也是为了看一下不等长布线会不会带来多少影响，时钟也只是133M，不是我调试的，我只是布线。后来调出来结果是时钟频率上不去，好像说只能跑10多M。不过SDRAM是离ARM远了一点，可能布线差距也超过了0.5inch，所以……如果还有下次，我会学着开发板那样正反贴，或者尽量靠近主控芯片。一般就不会有问题了。

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11楼
cubasa| | 2009-11-10 14:52 | 只看该作者
那是我第一次布ARM板，我也是为了看一下不等长布线会不会带来多少影响，时钟也只是133M，不是我调试的，我只是布线。后来调出来结果是时钟频率上不去，好像说只能跑10多M。不过SDRAM是离ARM远了一点，可能布线差距也超过了0.5inch，所以……如果还有下次，我会学着开发板那样正反贴，或者尽量靠近主控芯片。一般就不会有问题了。

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12楼
icecut| | 2009-11-11 14:14 | 只看该作者
我看教材写的挺简单,cadence.先预布线.然后选一个合适的长度,自动蛇形.最后调整一下等长值优化布线

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13楼
holle| | 2009-11-11 18:14 | 只看该作者
布蛇形线不是一件容易的事情，空间不够布不下，空间太大，线又长了

我布DDR部分，整整忙活了6个小时

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14楼
michael_li| | 2009-11-11 23:08 | 只看该作者
在成本 时间各方面考量，尽量做到误差最小吧
我们能做的就是这些，理论计算始终是理论

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15楼
michael_li| | 2009-11-11 23:10 | 只看该作者
不过话说回来
速度快的如FSB DDR，差个几十mils肯定是没有问题的
但是我们对layout提的要求都是10mils之内，哈哈

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16楼
cecwxf| | 2011-10-31 10:27 | 只看该作者
mark

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17楼
kokolin| | 2011-10-31 21:07 | 只看该作者
随便步 不用等长都可以。。

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