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高阻的问题？

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楼主
yangxiaolongqq|  楼主 | 2009-11-30 18:16 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
高阻, 悬空, 高阻态
小弟想在这里弱弱的问下，“高阻态”输出是否认为是输出脚悬空？

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沙发
maychang| | 2009-11-30 18:18 | 只看该作者
是。

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板凳
HWM| | 2009-11-30 18:20 | 只看该作者
对，理想的“高阻态”就是“断开”

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地板
iC921| | 2009-12-1 00:36 | 只看该作者
更准确的描述是：输出端呈“高阻态”时，可以该输出引脚视为悬空。

有时间限制。

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5楼
greenbud| | 2010-9-16 21:30 | 只看该作者
如果三态门高阻时，它的输出端（假设为y1）作为    另一个 两输入端与非门的一个输入信号，此与非门的另一个输入端加一个信号A，那么这个与非门的输出端是什么？

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6楼
greenbud| | 2010-9-16 21:31 | 只看该作者
[im[img][/img]g][/img]

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7楼
greenbud| | 2010-9-16 21:32 | 只看该作者

这是这道题的图

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8楼
maychang| | 2010-9-16 22:22 | 只看该作者
6楼：
需要看该与非门是用什么工艺生产的。
TTL芯片，输入悬空(前级输出为高阻态)时等于输入为高电平。CMOS工艺则电平不定。

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9楼
greenbud| | 2010-9-20 10:23 | 只看该作者
哈哈，真的是太太感谢您了，这个问题困我好久了:)

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