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[Actel FPGA]

求除法器的Verilog代码?

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沙发
wjj145| | 2010-3-7 09:11 | 只看该作者
Simulink hdl coder中有除法器,可以变换成verilog.具体文档是English,我没有认真读过.但是肯定有路!

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板凳
wjj145| | 2010-3-7 12:45 | 只看该作者
[local]1[/local]

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地板
beny5566| | 2010-3-9 16:54 | 只看该作者
楼上的真会找办法,
哈哈。
你是指用matlab中的dsp builder来做吗?

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3B1105| | 2010-3-9 21:34 | 只看该作者
楼上的说的不知道是否真的可行

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6
beny5566| | 2010-3-10 18:53 | 只看该作者
5# 3B1105
用DSP builder里的编译吧,直接编译成Verilog代码

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wjj145| | 2010-3-10 20:37 | 只看该作者
simulink hdl coder是mathworks的产品,不是 altera的dsp builer,也不是xilinx的system generator,simulink hdl coder和FPGA生产厂家无关.

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8
wjj145| | 2010-3-10 20:44 | 只看该作者
在MATLAB 2010a版本中,其组件simulink hdl coder已经部分支持除法器

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6019赵文| | 2010-3-11 22:36 | 只看该作者
学习了

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年轻不在| | 2010-3-14 17:54 | 只看该作者
MATLAB 2010a版本中,其组件simulink hdl coder已经部分支持除法器?我还不知道

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11
linhai1986| | 2010-3-14 22:19 | 只看该作者
是吗?看来的赶紧去掌握一下MATLAB了

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12
xiaoxin1986| | 2010-3-14 23:03 | 只看该作者
哟,matlab还有这个功能呢,去看看

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wjj145| | 2010-3-15 13:11 | 只看该作者
我看Simulink hdl coder象是硬件领域的"C语言",而verilog和vhdl就是硬件领域的"汇编语言".比喻不一定恰当,而掌握了C语言,非要精通汇编吗?仁者见仁.

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wjj145| | 2010-3-15 13:32 | 只看该作者

RE: 求除法器的Verilog代码?

我来show一下simulink hdl coder代码,myled.mdl是simulink hdl coder的模型,MYLED_CONTROL.m是模型的控制代码,hdlsrc是Simulink hdl coder生成的代码,只要copy这些代码便可用于任何公司的fpga,作为一个例子,使用了周立功easyFPGA 030,并建立了ACTEL LIBERO8.6工程,控制其四个LED.不信可以试试,是MATLAB 2009B.我可是帮了周立功一把,希望周立功不要杀我的猪了.[local]3[/local]

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wjj145| | 2010-3-15 13:47 | 只看该作者
代码怎么也上不去,在周立功bbs中FPGA中有

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wjj145| | 2010-3-15 13:47 | 只看该作者
代码怎么也上不去,在周立功bbs中FPGA中有

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17
sleepybear| | 2010-3-15 15:59 | 只看该作者
除法可以转换成乘以除数的倒数,依然用乘法解决。。。:L

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beny5566| | 2010-3-15 19:13 | 只看该作者
我想问问楼上的倒数怎么求,嘿嘿。

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20801233|  楼主 | 2010-3-15 19:50 | 只看该作者
我用Simulink hdl coder尝试了一下,
还不错,谢谢了。

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想实习去| | 2010-3-15 22:07 | 只看该作者
真是out了,赶紧去看看

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