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tps3824复位不正常，请教原因

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achen8413|  楼主 | 2007-11-26 19:24 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
ps, Reset, 电平, se, FPGA
我用FPGA出来的7.3M时钟 作为3824的wdi，假如是刚下载完程序不掉电，则3824的/reset脚为正常的高电平，假如掉电再上电，则变为了低电平，而此时wdi仍然有效，而且/reset脚为空载，没有连接到任何芯片上。请问高手，这是为何？

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