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想请教一个关于verilog代码的问题

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 楼主| jacobs 发表于 2016-6-15 22:45 | 显示全部楼层 |阅读模式
verilog, 代码, verilog代码, verilo
这个题的第三小小题是什么意思啊？我不是很懂他要求，有人可以写一下让我理解下吗？

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dirtwillfly 发表于 2016-6-16 09:16 | 显示全部楼层
不懂verilog
但第三题的意思不难理解，就是一个校验和输出控制
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玄德 发表于 2016-6-22 09:13 | 显示全部楼层

前两题是设计局部电路，
第3题是总体电路。


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