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为什么拆掉上拉就不RESET了

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javie|  楼主 | 2010-3-10 18:44 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
Reset, se, 电路, 电平
本帖最后由 javie 于 2010-3-10 21:40 编辑

电路如下：

加了上拉R425，3V3上电后会RESET有效输出低电平，但拆掉R425后，3V3上电后就没有RESET有效输出了，一直为高。 为啥？

RESET.jpg (21.82 KB )

RESET.jpg

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沙发
iC921| | 2010-3-10 18:49 | 只看该作者
可能是OC输出

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板凳
iC921| | 2010-3-10 18:49 | 只看该作者
或OD输出

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地板
iC921| | 2010-3-10 18:50 | 只看该作者
这种情况，恐怕不会一直为高

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5楼
虎虎生威| | 2010-3-10 18:50 | 只看该作者
有点晕啊

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6楼
iC921| | 2010-3-10 19:34 | 只看该作者
看了看资料，可能是R43太大了吧
http://www.21icsearch.com/pdfdetil_A4046B033B764C3E.html

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7楼
linqing171| | 2010-3-10 19:55 | 只看该作者
驱动高电平的能力丧失了。

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8楼
lai832| | 2010-3-10 22:15 | 只看该作者
同意９楼．
ＶＤＤ是接电源的．
Ｕ４３根本就没工作

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9楼
ShakaLeo| | 2010-3-11 11:04 | 只看该作者
个人觉得R43和C434完全没有必要，在VDD脚的电压上升至复位门限电压后，RESET脚仍会保持约200ms的低电平已确保可靠复位，这200ms的低电平对于3.3V电源的MCU来说足够复位了。

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10楼
yangwh0729| | 2010-3-11 13:31 | 只看该作者
?不懂

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11楼
wuxi_stl| | 2010-3-11 13:56 | 只看该作者
可能是输出类型吧！这个和下级电路有很大的关系。

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12楼
javie|  楼主 | 2010-3-11 21:32 | 只看该作者
找到原因了，因为我后面接了一个上拉，在VDD充电到1.1V前RESET输出会是高，而这个RESET又是我1。8V电压的EN，所以导致1。8会打开一段时间10多个ms，导致电路中某个IC开始初始化，但初始化没完毕前就会又掉电，所以工作不稳定

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