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请教一条VERILOG的语句

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小研究|  楼主 | 2016-7-20 09:45 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
沙发
zyingjie| | 2016-7-20 10:08 | 只看该作者
代码读不懂,为啥不多扩几个括号呢?

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板凳
玄德| | 2016-7-20 11:03 | 只看该作者

CSA、CSB是几位宽度?


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地板
小研究|  楼主 | 2016-7-20 13:44 | 只看该作者
搞明白了,的确是优先级的问题,&的优先级比==低。
或者多加括号。
谢谢。

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小研究|  楼主 | 2016-7-20 13:46 | 只看该作者
CSA和CSB是一位的片选信号,这条语句想表达:
主CPU(DSP)片选选中芯片A或B,且对其进行读操作的时候,芯片A或B的读信号有效。

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kk118a| | 2016-7-20 13:49 | 只看该作者
&和&&不 一样

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7
小研究|  楼主 | 2016-7-20 14:10 | 只看该作者
对于一位的变量来说,&和&&是一样的。二者的优先级都比==低,这点跟C语言差别很大。

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xmar| | 2016-7-20 14:29 | 只看该作者
本帖最后由 xmar 于 2016-7-20 14:49 编辑

第一个: IOR = /[(CSA*/CSB)*XR_W*/XRD]

第二个: IOR = /[(/CSA + /CSB)*XR_W*/XRD]

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