[Quartus] RTL Viewer仿真器件分析

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 楼主| 想学点什么 发表于 2017-2-18 23:48 | 显示全部楼层 |阅读模式
C:\Users\Administrator\Desktop\@~33`_M2[5N`ASX2E0VH1$L.png
C:\Users\Administrator\Desktop\NRD3GP6A4MS(6H][(FDK6[F.png
在verilog中比较器比较的值是999999,但在RTL Viewer中比较器的值为上图。
在verilog中加法器的值是1;但在RTL Viewer中比较器的值为上图。
 楼主| 想学点什么 发表于 2017-2-18 23:51 | 显示全部楼层
这是两个器件的图

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 楼主| 想学点什么 发表于 2017-2-24 22:51 | 显示全部楼层
我向着井口大喊了一声 “有人吗”。。。
腓特烈招惹了谁 发表于 2017-4-4 15:55 | 显示全部楼层
知道了 告诉我一声  同求
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