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SPI在PCB上走线需要注意什么，可以很近的并行走吗？

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楼主
al21bj|  楼主 | 2017-3-11 15:59 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
PCB, spi, pi, pc
如果并行走线数据线上会有CLK的干扰吧，虽然大多数都不影响使用，但需不需要注意呢？

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相关帖子
沙发
dirtwillfly| | 2017-3-11 16:42 | 只看该作者
你的spi通讯速度有多高？
一般情况并行走线就可以。

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板凳
shaliixi| | 2017-3-11 17:00 | 只看该作者
首先，   线路严格 串22欧电阻， 这个用来抗电磁干扰的。
第二， 线能粗则粗，能短则短。减小  线路寄生电容，电感。
第三， 可以走 弧形线就走弧形线。
第四， 严格 用地包络屏蔽。防止静电。
。。。、。。

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地板
al21bj|  楼主 | 2017-3-11 17:10 | 只看该作者
dirtwillfly 发表于 2017-3-11 16:42
你的spi通讯速度有多高？
一般情况并行走线就可以。

从几百k到10多M，但数据线上都有CLK同步干扰，波形看上去难看

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5楼
玄德| | 2017-3-11 20:28 | 只看该作者
al21bj 发表于 2017-3-11 17:10
从几百k到10多M，但数据线上都有CLK同步干扰，波形看上去难看


只要干扰幅度不影响电平判别，就没问题。

我用几十M，线也走很近，中心间距10mil。


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6楼
06007507| | 2017-3-12 13:24 | 只看该作者
严格控制信号线的阻抗，发送端串接一个你设计PCB的（特征阻抗-17Ω）左右的电阻，特别是时钟。点对多时不要开叉太长，尽量以菊花链的形式串接起来，另外考虑一下驱动是否足够。

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7楼
bluekun| | 2017-3-16 13:45 | 只看该作者
spi频率不会太高，pcb走线要求不高，时钟线能包地就包，不能就和其他信号保持3倍线间距

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8楼
dsyq| | 2017-11-8 12:31 | 只看该作者
学习.

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9楼
ZHONGLAN| | 2017-11-16 11:16 | 只看该作者

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10楼
xiaxingxing| | 2017-11-16 21:54 | 只看该作者
一般的 频率不高的情况下，基本上把线连起来了就没多大问题。

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11楼
chunyang| | 2017-11-17 16:20 | 只看该作者
SPI不是长线通迅标准，速度也不高，板内器件互连无需考虑什么互扰问题，按一般IO处理即可。

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12楼
yes19891989| | 2017-11-17 16:53 | 只看该作者
SPI通信，不用特意处理，本身速度也不高

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