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高速FPGA与DDR2布线怎么做到等长等间距？

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青瞳i|  楼主 | 2017-3-21 17:49 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
DDR, FPGA, 布线, PCB, pcb布线
求教USB3.0与FPGA以及DDR2的PCB布线怎么能保证速度达到300M？

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青瞳i|  楼主 | 2017-3-21 17:54 | 只看该作者
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jjjyufan| | 2017-3-22 09:33 | 只看该作者
莫非你规则没设，随手画的等长？

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地板
青瞳i|  楼主 | 2017-3-22 09:59 | 只看该作者
jjjyufan 发表于 2017-3-22 09:33
莫非你规则没设，随手画的等长？

现在是等长了，没有等间距啊，如果用差分线来拉的话应该怎么设置规则？

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5楼
jjjyufan| | 2017-3-22 13:15 | 只看该作者
时钟对设置差分等长即可
地址 数据不用差分的

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6楼
syzdq| | 2017-3-26 08:39 | 只看该作者
好的软件只要你设置好相应的等长规则，差分规则等就行了，差分100欧等具体要求器件手册中一般会给出的，再用SI9000之类的软件来计算出相关参数填入规则中。

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7楼
319866401| | 2020-9-23 14:50 | 只看该作者
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8楼
hehailun| | 2020-9-24 17:43 | 只看该作者
本帖最后由 hehailun 于 2020-9-24 17:44 编辑

来  让哥手把手教你  哈哈

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