[PCB] 高速FPGA与DDR2布线怎么做到等长等间距?

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 楼主| 青瞳i 发表于 2017-3-21 17:49 | 显示全部楼层 |阅读模式
求教USB3.0与FPGA以及DDR2的PCB布线怎么能保证速度达到300M?

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 楼主| 青瞳i 发表于 2017-3-21 17:54 | 显示全部楼层
DDR2

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jjjyufan 发表于 2017-3-22 09:33 | 显示全部楼层
莫非你规则没设,随手画的等长?
 楼主| 青瞳i 发表于 2017-3-22 09:59 | 显示全部楼层
jjjyufan 发表于 2017-3-22 09:33
莫非你规则没设,随手画的等长?

现在是等长了,没有等间距啊,如果用差分线来拉的话应该怎么设置规则?
jjjyufan 发表于 2017-3-22 13:15 | 显示全部楼层
时钟对设置差分等长即可
地址 数据不用差分的
syzdq 发表于 2017-3-26 08:39 | 显示全部楼层
好的软件只要你设置好相应的等长规则,差分规则等就行了,差分100欧等具体要求器件手册中一般会给出的,再用SI9000之类的软件来计算出相关参数填入规则中。
319866401 发表于 2020-9-23 14:50 | 显示全部楼层
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hehailun 发表于 2020-9-24 17:43 | 显示全部楼层
本帖最后由 hehailun 于 2020-9-24 17:44 编辑

来  让哥手把手教你  哈哈

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