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[Actel FPGA]

分配引脚时出现问题

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楼主
米其林r|  楼主 | 2010-4-29 16:09 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
沙发
bit6019| | 2010-4-29 16:10 | 只看该作者
看下设计中的某些信号,比如复位和时钟信号有没有上全局网络

没有的话加约束上全局后就可以自由分配引脚

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板凳
金鱼木鱼| | 2010-4-29 16:15 | 只看该作者
怎么约束,在哪里写呢

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