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不用的IO口可以悬空吗？

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楼主
handleMessage|  楼主 | 2017-4-15 09:52 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
IO, 单片机, 接地, 电路
单片机不用的IO口可以悬空吗？还是有更好的办法，都接地的话，万一电路需要修改就麻烦了。。

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沙发
zhouhuanの| | 2017-4-15 09:56 | 只看该作者
可以的，自己设置一下高阻。

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板凳
wanglaojii| | 2017-4-15 09:59 | 只看该作者
FPGA的设计一般都是需要设置高阻状态的。

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地板
laozhongyi| | 2017-4-15 10:02 | 只看该作者
设置为输出，输出低电平
P1DIR = 0XFF;
P1OUT = 0X00;

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5楼
Edisons| | 2017-4-15 10:08 | 只看该作者
不是有内部上拉/下拉么？用软件方法试试。。

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6楼
bbapple| | 2017-4-15 10:12 | 只看该作者
默认是输入，要是输入就不能“悬”了，悬着那就悬了。

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7楼
_gege| | 2017-4-15 10:17 | 只看该作者
要不设置为输出，要不就加个上拉！

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8楼
Mozarts| | 2017-4-15 10:20 | 只看该作者
一般都是做悬空处理的啊，特别是想征程低功耗设计的时候是很有必要的

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9楼
Listate| | 2017-4-15 10:24 | 只看该作者
最好不要悬空，这样的引脚信号不一定。

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10楼
Lbsonggz| | 2017-4-15 12:20 | 只看该作者
输出，低电平，提高EMI/EMC

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11楼
mmuuss586| | 2017-4-15 12:53 | 只看该作者
可以；

你也可以悬空后，程序设置成输出；

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12楼
sszxxm| | 2017-4-15 17:00 | 只看该作者
最稳定靠谱的是设置为带上拉的输入方式，这样即使外部不慎被短路到电源或地，或者随便中间哪个电压，都不会造成损害，只要不超过VDD，就是很安全的。

如果设置为高阻，那么这个状态就会漂浮不定，尤其在上电的瞬间，你的程序还没有复位初始化运行，各种错综复杂的因素可能会干扰到后续的正常运行。
如果设置为输出，那么有2种状态，输出0，那么万一不小心这个IO接到了VDD，那就有可能一缕青烟了，同样如果输出1，不小心接了地，这条IO烧掉事小，影响整个芯片事大。

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wforest68 2017-4-16 22:34 回复TA
最好的方案 
13楼
typeof| | 2017-4-15 23:25 | 只看该作者
可以悬空，别配置防止干扰。

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14楼
typeof| | 2017-4-15 23:30 | 只看该作者
楼主这是用的哪个芯片，可以配置三态。

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15楼
yiy| | 2017-4-16 14:18 | 只看该作者
不用的可以设置为输出模式，然后再悬空。。

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