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关于千兆以太网，UDP传输漏包的问题

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sunnysnow|  楼主 | 2017-5-15 09:16 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
千兆以太网, udp, FIFO, AD, AC
本帖最后由 sunnysnow 于 2017-5-18 09:19 编辑

      FPGA千兆以太网发送数据，数据来自AD采集（有60MHz），经FIFO缓存。采用的UDP协议，一帧一帧传输数据，最后通信成功，但是漏包严重，后来发现是因为：AD不停地采集数据，但每一帧UDP数据包还需要传输包头、地址、端口号等，这段时间里采集的数据就丢失了。请问大家有没有什么解决办法呢？补充：我用的FIFO，它缓存不了数据：

括号里是一个周期的正弦波信号。很明显写和读数据的长度是一致的，但箭头指向的就是数据漏掉的部分。我必须给一个读使能无效的信号，刚无效几个时钟后，就写满了？不可能啊？我的fifo读、写时钟频率和数据位宽是一致的，深度4096.

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沙发
bbjj123| | 2017-5-15 15:23 | 只看该作者
发的没有采集的快，肯定漏

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板凳
sunnysnow|  楼主 | 2017-5-15 19:22 | 只看该作者
bbjj123 发表于 2017-5-15 15:23
发的没有采集的快，肯定漏

你说的对，但我的不是这个问题，我的问题是UDP包的发送是有格式的，它在添加包头等信息时，采集的数据就漏掉了。发送和采集的频率刚好是合适的。

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地板
bbjj123| | 2017-5-16 10:04 | 只看该作者
本帖最后由 bbjj123 于 2017-5-16 10:06 编辑

缓存数据

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5楼
bbjj123| | 2017-5-16 10:06 | 只看该作者
或者搞个乒乓操作

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6楼
Yan.hong.yu| | 2017-5-16 16:45 | 只看该作者
经过FIFO缓存，还丢数据，要么FIFO数据深度不够，要么就是发的比采集的慢

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7楼
sunnysnow|  楼主 | 2017-5-16 20:23 | 只看该作者
Yan.hong.yu 发表于 2017-5-16 16:45
经过FIFO缓存，还丢数据，要么FIFO数据深度不够，要么就是发的比采集的慢

我用FIFO发现它只有一个先进先出的功能，不会接着往后缓存，它会溢出，必须写读是同步的。关于这点我也很困惑

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8楼
Yan.hong.yu| | 2017-5-17 09:32 | 只看该作者
sunnysnow 发表于 2017-5-16 20:23
我用FIFO发现它只有一个先进先出的功能，不会接着往后缓存，它会溢出，必须写读是同步的。关于这点我也很 ...

发送和采集是不是两个时钟域的？如果是两个时钟域的，你的FIFO需要读时钟和写时钟。
其实你可以仿真一下，很快就能解决问题。

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9楼
ar_dong| | 2017-5-21 21:52 | 只看该作者
采集时钟频率降低点啊，

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