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[FPGA] 问一下，加法器的问题

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725|0
 楼主| kuailebao 发表于 2017-5-16 15:03 | 显示全部楼层 |阅读模式
加法器, module, Output, TPU, Input
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  1. module add_4(X,Y,sum,C);
    

  2. input[3:0] X,Y;
    

  3. output[3:0] sum;
    

  4. output C;
    

  5. assign{c,sum}=X+Y;
    

  6. endmodule

像这种写的加法器，在硬件上是普通的加法器，还是超前的加法器？
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