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定时器的PWM输出问题

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george3023|  楼主 | 2010-5-15 11:02 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
PWM输出, 定时器, ST, BUG, UG
ST的勘误手册上提到通用定时器的PWM输出限制，我们在使用高级定时器时也是如此，即输出占空比为100%的PWM时，由于保护的需要会给OCREF_CLR信号施加一个高电平，系统正常后（保护取消），PWM输出不能重新开始，这个对于变频调速领域的应用无疑是致命的bug，更让人绝望的是ST并没有解决方法，不知道大家在用到这方面功能时是如何处理的？

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