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急问:运放的增益问题

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沙发
sxdxy| | 2010-5-17 19:54 | 只看该作者
这是Razavi书上的图,你的Vb1、Vb2、Vb3、VDD是多少?

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板凳
sunnylgf|  楼主 | 2010-5-17 20:16 | 只看该作者
本帖最后由 sunnylgf 于 2010-5-17 20:17 编辑

下面是我的电路图
VREF对吗? 2# sxdxy

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地板
sxdxy| | 2010-5-17 22:16 | 只看该作者
首先偏置还是有问题的,最上面的两个PMOS漏极电压高于栅极,那么两个PMOS处于线性区,电阻就小了,那增益就降下来了。其次电压比较器,我认为Razavi的原图是示意图。而你用了一个实际的运放,又没有负反馈。这种电压比较器只要输入稍有误差输出不是6V就是-6V。所以我认为这里有待商榷

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