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[Actel FPGA]

[求助]max delay timing requirements have not been met

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北京户口|  楼主 | 2010-5-18 22:37 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
沙发
金鱼木鱼| | 2010-5-18 22:40 | 只看该作者
这个修行需要靠个人,时序不满足最终是要解决组合逻辑太长的问题,减少组合逻辑以及在组合逻辑插入流水线是两种好的方法,请多到网站上找些资料~

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