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：[求助]请教版主一个关于FPGA实现除法器的问题

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北京户口|  楼主 | 2010-5-30 13:00 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
除法器, FPGA实现, 二进制, 数据处理
目前我写的除法器程序进行完除法后得一个商和余数，因为数据处理的需要，最好能除出来是个用二进制表示的小数，我想问下利用FPGA能不能实现带小数的除法预算？

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沙发
金鱼木鱼| | 2010-5-30 13:06 | 只看该作者
带小数的除法运算没有现成的模块，这需要你自己用Verilog代码实现～

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