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[FPGA] timescale是专门用于仿真的吗，不能综合吗

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 楼主| ablitt 发表于 2017-6-21 16:46 | 显示全部楼层 |阅读模式
times, 仿真, SCALE, module, 源码
我有个源码，开头有个timescale，而我只是想要把这个module综合出来。不用仿真。应该怎么修改呢？
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