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选择VHDL还是verilog HDL？

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akii|  楼主 | 2010-7-19 16:10 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
verilog, VHDL, vhdl语言, hdl语言
本帖最后由 jancey 于 2010-7-21 09:30 编辑

一直在用VHDL语言，但是在网上看到好多人用Verilog。请问大家我有必要转型学Verilog吗？

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沙发
jancey| | 2010-7-21 09:31 | 只看该作者
很有必要，verilog使用率很高，而且有vhdl基础，学起来很容易！

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板凳
小毛毛虫| | 2010-7-21 09:39 | 只看该作者
Verilog比VHDL更加简洁好用,毕竟VHDL是政府开发的,Verilog是公司开发的. 但是目前很多大系统开发, 通常是这两种语言混合用, 因为系统模块可能来自不同公司和设计人员.

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地板
akii|  楼主 | 2010-7-21 09:46 | 只看该作者
那么 VerilogHDL 比 VHDL 更流行，是吧？

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5楼
barryyan| | 2010-7-21 09:57 | 只看该作者
恩，verilog更流行

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6楼
hsw_21| | 2010-7-21 18:00 | 只看该作者
看哪里需要了，如果要进 美国国防部 就业，得学 VHDL.

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7楼
蝴蝶好小子| | 2010-8-5 11:24 | 只看该作者
6# hsw_21


你好呀  我看见你说就业也要学习VHDL，不见得吧，现在企业用Verilog的很多呢

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8楼
大杂烩| | 2010-8-5 11:32 | 只看该作者
Verilog 简单方便

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9楼
zbok5947| | 2010-8-5 15:40 | 只看该作者
都学吧，学了一个另一个就很简单了，看公司让你用哪个你就用哪个

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10楼
ren8zhang8| | 2010-8-10 11:31 | 只看该作者
VerilogHDL 简单，方便，好学，正在学习中

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11楼
wxfxwk1986| | 2010-8-24 16:34 | 只看该作者
Verilog相对灵活，而vhdl相对严谨，一般台湾日本这些公司用vhdl多，。其实用什么语言不是关键，最主要的是电路。

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12楼
Liuweixing| | 2010-8-25 19:28 | 只看该作者
不管是VHDL，还是Verilog,它们仅仅是设计工具，只要一种掌握得很熟练就行了，语言这东西只是干活的工具而矣，千万不要以为学习了几种语言就是干了不少活，这是两码事。

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13楼
wujing198| | 2010-8-26 13:44 | 只看该作者
乱说了吧，亚太地区都是Verilog的天下。 11# wxfxwk1986

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14楼
akiller| | 2010-8-27 10:01 | 只看该作者
我们上课用的是VHDL，但是课设和毕设用的是Verilog，貌似会学完VHDL后转到Verilog不是很难。

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15楼
头上长草| | 2010-10-17 15:58 | 只看该作者
我们EDA课程里教的是VHDL

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16楼
yuanxinchao| | 2010-10-19 12:29 | 只看该作者
两者各有各的好

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17楼
xueqi_147| | 2010-10-20 12:35 | 只看该作者
vhdl一半是军用的吧  商用一半是verilog

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