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新手问题!!编码(并进串出问题)

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沙发
ar_dong| | 2010-7-21 22:32 | 只看该作者
拿着协议啃就成了

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板凳
gxs64| | 2010-7-22 11:37 | 只看该作者
module hc74hc164 (clk , en , clear , in, data);
input clk ,in , en , clear;
output [7:0] data;
reg [7:0] data;
always @ (posedge clk)
        begin
                if(!clear)
                        begin
                                data<=8'h0;        //
                        end       
                else if(en)
                        begin
                                //data<={data , in};
                                data[7:0] <= {data[6:0] , in};
                                //$disply("data=%h\n");
                        end       
        end
endmodule

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地板
zhangyongpig|  楼主 | 2010-7-22 16:51 | 只看该作者
不好意思啊  我想要vhdl的,编码程序里应该如何嵌套移位模块来实现串行输出呢? 3# gxs64

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gxs64| | 2010-7-23 20:22 | 只看该作者
原理一样,语法不一样

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