VHDL数组问题

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 楼主| x_tin 发表于 2010-7-29 09:01 | 显示全部楼层 |阅读模式
我想实现一个 数组的索引由 信号来控制;

比如: SIGNAL a: STD_LOGIC_VECTOR(7 DOWNTO 0);
          SIGNAL b: STD_LOGIC_VECTOR(2 DOWNTO 0);

           PROCESS(CLK,RST)

                  a(b) <='1';   --这条综合的时候出错了

                  case b is       --难道必须写成这样?
                   when "000" =>
                           a(0) <='1';
                   when "001" =>
                           a(1) <='1';   
                   when "010" =>
                           a(2) <='1';  
                   when "011" =>
                           a(3) <='1';  

                      。。
                      。。



可是 如果 我有1024个位喃,难道也要这么写啊。。

大虾们,怎么写啊
 楼主| x_tin 发表于 2010-7-29 09:05 | 显示全部楼层
是不是 b 要类型转换? 转换成 整型.   我来试下!
 楼主| x_tin 发表于 2010-7-29 09:19 | 显示全部楼层
还真行了。 结贴
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