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[Actel FPGA]

管脚分配问题

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huzixian|  楼主 | 2010-8-8 14:56 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
沙发
bit6019| | 2010-8-16 21:40 | 只看该作者
某些高扇出系数的引脚如时钟,复位信号,只能从某些特定的全局引脚输入。

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