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[知识] wire,和register赋值的区别

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jie4567|  楼主 | 2010-8-27 09:55 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
wire,和register赋值的区别
wire是线网变量,不能在always\initial后,用assign直接赋值。赋值是在输入发生变化时进行,不能保持。
register是寄存器变量,只能在always\initial后,一般不用assign,使用“=”或“<=”赋值。有时也可以用assign,但只能用“=”。赋值只在always\initial后的事件发生时进行,输入变化不影响原来的赋值结果。如果没有事件发生,输入发生了变化,赋值也不能进行,将保持原来的赋值结果。
两个的区别有点象组合逻辑与时序逻辑之间的区别一样。

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沙发
AutoESL| | 2011-6-26 12:38 | 只看该作者
:)

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板凳
AutoESL| | 2011-6-26 12:38 | 只看该作者
这个应该是原创

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地板
tikelu| | 2011-6-26 22:46 | 只看该作者
看了 挺有感触的

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5
tikelu| | 2011-6-26 22:46 | 只看该作者
谢谢楼主的分享

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6
年轻不再| | 2011-6-26 22:54 | 只看该作者
:hug:

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7
GoldSunMonkey| | 2011-6-27 03:55 | 只看该作者
两个的区别有点象组合逻辑与时序逻辑之间的区别一样。 这句话是最重要的~

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8
wewo| | 2011-6-27 11:08 | 只看该作者
我也认同楼上所说的

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